Symbol Refere" />
參數(shù)資料
型號(hào)： IDT79RC32H435-300BCI
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 14/53頁(yè)
文件大?。?/td> 0K
描述： IC MPU 32BIT CORE 300MHZ 256-BGA
標(biāo)準(zhǔn)包裝： 90
系列： Interprise™
處理器類型： MIPS32 32-位
速度： 300MHz
電壓： 1.2V
安裝類型： 表面貼裝
封裝/外殼： 256-LBGA
供應(yīng)商設(shè)備封裝： 256-CABGA（17x17）
包裝： 托盤
其它名稱： 79RC32H435-300BCI
21 of 53
January 19, 2006
IDT 79RC32435
Figure 7 DDR SDRAM Timing Waveform — Write Access
Signal
Symbol Reference
Edge
266MHz
300MHz
350MHz
400MHz
Unit
Condi-
tions
Timing
Diagram
Reference
Min
Max
Min
Max
Min
Max
Min
Max
Memory and Peripheral Bus1
See Figures 8
and 9.
MADDR[21:0]
Tdo_8a
EXTCLK rising
0.4
4.5
0.4
4.5
0.4
4.5
0.4
4.5
ns
Tdz_8a2
——
———
ns
Tzd_8a2
——
———
ns
MADDR[25:22]
Tdo_8b
EXTCLK rising
0.4
4.5
0.4
4.5
0.4
4.5
0.4
4.5
ns
Tdz_8b2
——
———
ns
Tzd_8b2
——
———
ns
Table 8 Memory and Peripheral Bus AC Timing Characteristics (Part 1 of 2)
2 DDRDATA is either 32-bits or 16-bits wide depending on the DBW control bit in DDRC Register
RowA
Col A0
Col A2
NOP
ACTV
NOP
WR
NOP
BNKx
FF
DM0 DM1
DM3
FF
D0
D1
D2
D3
Tdo_7k
Tdo_7l
Tdo_7m
DDRCKP
DDRCKN
DDRCSN
DDRADDR[13:0]
DDRCMD1
DDRCKE
DDRBA[1:0]
DDRDQSx
DDRDM[1:0]
DDRDATA[15:0]2
DM2
1 DDRCMD contains DDRRASN, DDRCASN and DDRWEN.
(see Chapter 7, DDR Controller, in the RC32435 User Reference Manual).
DDRDQSx
相關(guān)PDF資料
PDF描述
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IDT71V67703S80BG IC SRAM 9MBIT 80NS 119BGA
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AMM40DTBD-S189 CONN EDGECARD 80POS R/A .156 SLD
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參數(shù)描述
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