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參數(shù)資料
| 型號(hào)： | IDT5T9890NLGI |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 14/37頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK DRIVER 2.5V PLL 68-VFQFPN |
| 產(chǎn)品變化通告： | Product Discontinuation 05/Jan/2011 |
| 標(biāo)準(zhǔn)包裝： | 168 |
| 類型： | PLL 時(shí)鐘驅(qū)動(dòng)器 |
| PLL： | 帶旁路 |
| 輸入： | eHSTL，HSTL，LVPECL，LVTTL |
| 輸出： | eHSTL，HSTL，LVTTL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:10 |
| 差分 - 輸入:輸出： | 是/無 |
| 頻率 - 最大： | 250MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 2.3 V ~ 2.7 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 68-VFQFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 68-VFQFPN（10x10） |
| 包裝： | 托盤 |
| 其它名稱： | 5T9890NLGI |
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21
INDUSTRIALTEMPERATURERANGE
IDT5T9890
EEPROM PROGRAMMABLE 2.5V PROGRAMMABLE SKEW PLL CLOCK DRIVER
AC DIFFERENTIAL INPUT SPECIFICATIONS(1)
Symbol
Parameter
Min.
Typ.
Max
Unit
t W
Reference/Feedback Input Clock Pulse Width HIGH or LOW (HSTL/eHSTL outputs)(2)
1—
—
ns
Reference/Feedback Input Clock Pulse Width HIGH or LOW (2.5V / 1.8V LVTTL outputs)(2)
1—
—
HSTL/eHSTL/1.8V LVTTL/2.5V LVTTL
VDIF
ACDifferentialVoltage(3)
400
—
mV
VIH
AC Input HIGH(4,5)
Vx + 200
—
mV
VIL
AC Input LOW(4,6)
—
Vx - 200
mV
LVEPECL
VDIF
ACDifferentialVoltage(3)
400
—
mV
VIH
AC Input HIGH(4)
1275
—
mV
VIL
AC Input LOW(4)
—
875
mV
NOTES:
1. For differential input mode, Bits 35 - 30 = 1.
2. Both differential input signals should not be driven to the same level simultaneously. The input will not change state until the inputs have crossed and the voltage range defined
by VDIF has been met or exceeded.
3. Differential mode only. VDIF specifies the minimum input voltage (VTR - VCP) required for switching where VTR is the "true" input level and VCP is the "complement" input level.
The AC differential voltage must be achieved to guarantee switching to a new state.
4. For single-ended operation, REF[1:0]/VREF[1:0] is tied to the DC voltage VREF[1:0]. Refer to each input interface's DC specification for the correct VREF[1:0] range.
5. Voltage required to switch to a logic HIGH, single-ended operation only.
6. Voltage required to switch to a logic LOW, single-ended operation only.
相關(guān)PDF資料 |
PDF描述 |
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| IDT5T9821NLGI8 | IC CLK DRIVER ZD PLL 68-VFQFPN |
| IDT5T9821NLGI | IC CLK DRIVER ZD PLL 68-VFQFPN |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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