參數資料
型號： ICS9FG108YGLF-T
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： XO, clock
英文描述： Frequency Generator for CPU, QPI, FBD, PCIe Gen 2 & SATA
中文描述： 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48
封裝： 6.10 MM WIDTH, 0.50 MM PITCH, ROHS COMPLIANT, MO-153, TSSOP-48
文件頁數： 12/19頁
文件大?。?/td> 263K
代理商： ICS9FG108YGLF-T
IDT
TM
/ICS
TM
Frequency Generator for CPU, QPI, FBD, PCIe Gen 2 & SATA
ICS9FG108 REV G 04/06/07
ICS9FG108
Frequency Generator for CPU, QPI, FBD, PCIe Gen 2 & SATA
12
Absolute Max
Symbol
VDD_A
VDD_In
Ts
Tambient
Tcase
Electrical Characteristics - Input/Supply/Common Output Parameters
T
A
= 0 - 70°C; Supply Voltage V
DD
= 3.3 V +/-5%
PARAMETER
SYMBOL
Parameter
Min
Max
Units
V
V
°
C
°C
°C
3.3V Core Supply Voltage
3.3V Logic Input Supply Voltage
Storage Temperature
Ambient Operating Temp
Case Temperature
Input ESD protection
human body model
V
DD
+ 0.5V
V
DD
+ 0.5V
150
70
115
GND - 0.5
-65
0
ESD prot
2000
V
CONDITIONS
MIN
TYP
MAX
UNITS NOTES
Input High Voltage
V
IH
3.3 V +/-5%
2
V
DD
+ 0.3
V
Input Low Voltage
V
IL
3.3 V +/-5%
V
SS
-
0.3
-5
0.8
V
Input High Current
I
IH
V
IN
= V
DD
5
uA
I
IL1
V
IN
= 0 V; Inputs with no pull-
up resistors
-5
uA
I
IL2
V
IN
= 0 V; Inputs with pull-up
resistors
Full Active, C
L
= Full load;
f = 400 MHz
Full Active, C
L
= Full load;
f = 100 MHz
All outputs stopped driven
All outputs stopped Hi-Z
V
DD
= 3.3 V
-200
uA
215
250
mA
1
180
200
mA
1
180
51
200
60
25
7
5
6
mA
mA
MHz
nH
pF
pF
1
1
3
1
1
1
Input Frequency
3
Pin Inductance
1
Input/Output
Capacitance
1
F
i
L
pin
C
IN
C
OUT
14
Logic Inputs
Output pin capacitance
From V
DD
Power-Up and after
input clock stabilization to 1st
clock
Triangular Modulation
DIF output enable after
DIF_Stop# de-assertion
1.5
Clk Stabilization
1,2
T
STAB
1
1.8
ms
1,2
Modulation Frequency
f
MOD
30
33
kHz
1
DIF output enable
t
DIFOE
9.8
15
ns
1
Input Rise and Fall times
t
R
/t
F
20% to 80% of VDD
5
ns
1
1
Guaranteed by design and characterization, not 100% tested in production.
2
See timing diagrams for timing requirements.
3
Input frequency should be measured at the REFOUT pin and tuned to ideal 14.31818MHz or 25
MHz to meet
Input Low Current
Operating Supply Current
I
DD3.3OP
I
DD3.3STOP
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