參數(shù)資料
型號(hào)： ICS854S54AYI-08LFT
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 15/21頁
文件大?。?/td> 0K
描述： IC CLK BUFF MUX 2:1/1:2 64-TQFP
標(biāo)準(zhǔn)包裝： 500
系列： HiPerClockS™
類型： 扇出緩沖器（分配），多路復(fù)用器
電路數(shù)： 8
比率 - 輸入:輸出： 2:1，1:2
差分 - 輸入:輸出： 是/是
輸入： CML，LVDS，LVPECL
輸出： LVDS
頻率 - 最大： 1.3GHz
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 64-TQFP 裸露焊盤
供應(yīng)商設(shè)備封裝： 64-TQFP-EP（10x10）
包裝： 帶卷 (TR)
其它名稱： 854S54AYI-08LFT
ICS854S54AYI-08 FEBRUARY 4, 2010
3
2010 Integrated Device Technology, Inc.
ICS854S54I-08 Data Sheet
OCTAL 2:1 AND 1:2 DIFFERENTIAL-TO-LVDS MULTIPLEXER
Table 1. Pin Descriptions
NOTE: Pullup refers to internal input resistors. See Table 2, Pin Characteristics, for typical values.
Number
Name
Type
Description
1, 2
4, 5
QA0, nQA0
QA1, nQA1
Output
Differential output pair. LVDS interface levels.
3, 14, 26, 35, 46, 55
GND
Power
Power supply ground.
6, 11, 23, 38, 43, 58
VDD
Power
Power supply pins.
7, 8
QB, nQB
Output
Differential output pair. LVDS interface levels.
9, 10
nQF, QF
Output
Differential output pair. LVDS interface levels.
12, 13
15, 16
nQE1, QE1
nQE0, QE0
Output
Differential output pair. LVDS interface levels.
17
nINF
Input
Pullup/
Pulldown
Inverting differential LVPECL clock input. VDD/2 default when left
floating.
18
INF
Input
Pulldown
Non-inverting differential LVPECL clock input.
19, 21
nINE1, nINE0
Input
Pullup/
Pulldown
Inverting differential LVPECL clock input. VDD/2 default when left
floating.
20, 22
INE1, INE0
Input
Pulldown
Non-inverting differential LVPECL clock input.
24, 25
ADR1, ADR0
Input
Pulldown
Serial address select pins. LVCMOS / LVTTL interface levels.
27, 29
ING0, ING1
Input
Pulldown
Non-inverting differential LVPECL clock input.
28, 30
nING0, nING1
Input
Pullup/
Pulldown
Inverting differential LVPECL clock input. VDD/2 default when left
floating.
31
INH
Input
Pulldown
Non-inverting differential LVPECL clock input.
32
nINH
Input
Pullup/
Pulldown
Inverting differential LVPECL clock input. VDD/2 default when left
floating.
33, 34
36, 37
QG0, nQG0
QG1, nQG1
Output
Differential output pair. LVDS interface levels.
39, 40
QH, nQH
Output
Differential output pair. LVDS interface levels.
41, 42
nQD, QD
Output
Differential output pair. LVDS interface levels.
44, 45
47, 48
nQC1, QC1
nQC0, QC0
Output
Differential output pair. LVDS interface levels.
49
nIND
Input
Pullup/
Pulldown
Inverting differential LVPECL clock input. VDD/2 default when left
floating.
50
IND
Input
Pulldown
Non-inverting differential LVPECL clock input.
51, 53
nINC1, nINC0
Input
Pullup/
Pulldown
Inverting differential LVPECL clock input. VDD/2 default when left
floating.
52, 54
INC1, INC0
Input
Pulldown
Non-inverting differential LVPECL clock input.
56
SCLK
Input
Pullup
I2C Serial address select pin. LVCMOS/LVTTL interface levels.
57
SDA
Input
Pullup
I2C Shift register serial input. Data sampled on the rising edge of
SCLK. LVCMOS/LVTTL interface levels.
59, 61
INA0, INA1
Input
Pulldown
Non-inverting differential LVPECL clock input.
60, 62
nINA0, nINA1
Input
Pullup/
Pulldown
Inverting differential LVPECL clock input. VDD/2 default when left
floating.
63
INB
Input
Pulldown
Non-inverting differential LVPECL clock input.
64
nINB
Input
Pullup/
Pulldown
Inverting differential LVPECL clock input. VDD/2 default when left
floating.
相關(guān)PDF資料
PDF描述
ICS853S024AYLFT IC CLK BUFF 1:24 1.5GHZ 64-TQFP
ICS8524AYLFT IC CLK BUFFER MUX 2:22 64-ETQFP
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參數(shù)描述
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ICS858011AKLF 功能描述:IC CLK BUFF 1:2 2.5GHZ 16-VFQFPN RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘緩沖器，驅(qū)動(dòng)器 系列:HiPerClockS™ 標(biāo)準(zhǔn)包裝:74 系列:- 類型:扇出緩沖器（分配） 電路數(shù):1 比率 - 輸入:輸出:1:10 差分 - 輸入:輸出:是/是 輸入:HCSL, LVCMOS, LVDS, LVPECL, LVTTL 輸出:HCSL，LVDS 頻率 - 最大:400MHz 電源電壓:3 V ~ 3.6 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:32-VFQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:32-QFN（5x5） 包裝:管件
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