參數(shù)資料
型號(hào)： ICS844003BG-01LFT
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 5/19頁
文件大?。?/td> 0K
描述： IC SYNTHESIZER 3LVDS 24-ETSSOP
產(chǎn)品培訓(xùn)模塊： PCI-Express
標(biāo)準(zhǔn)包裝： 2,500
系列： HiPerClockS™, FemtoClock™
類型： 頻率合成器
PLL： 帶旁路
輸入： LVCMOS，LVTTL，晶體
輸出： LVDS
電路數(shù)： 1
比率 - 輸入:輸出： 2:3
差分 - 輸入:輸出： 無/是
頻率 - 最大： 680MHz
除法器/乘法器： 是/無
電源電壓： 3.135 V ~ 3.465 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 24-TSSOP（0.173"，4.40mm 寬）
供應(yīng)商設(shè)備封裝： 24-TSSOP
包裝： 帶卷 (TR)
其它名稱： 844003BG-01LFT
ICS844003-01
FEMTOCLOCKSCRYSTAL-TO- LVDS FREQUENCY SYNTHESIZER
IDT / ICS LVDS FREQUENCY SYNTHESIZER
13
ICS844003BG-01 REV. A AUGUST 21, 2008
Recommendations for Unused Input and Output Pins
Inputs:
Crystal Inputs
For applications not requiring the use of the crystal oscillator input,
both XTAL_IN and XTAL_OUT can be left floating. Though not
required, but for additional protection, a 1k
resistor can be tied
from XTAL_IN to ground.
REF_CLK Input
For applications not requiring the use of the reference clock,
it can be left floating. Though not required, but for additional
protection, a 1k
resistor can be tied from the REF_CLK to
ground.
LVCMOS Control Pins
All control pins have internal pullups or pulldowns; additional
resistance is not required but can be added for additional
protection. A 1k
resistor can be used.
Outputs:
LVDS Outputs
All unused LVDS output pairs can be either left floating or
terminated with 100
across. If they are left floating, we
recommend that there is no trace attached.
3.3V LVDS Driver Termination
A general LVDS interface is shown in Figure 4 In a 100
differential
transmission line environment, LVDS drivers require a matched
load termination of 100
across near the receiver input. For a
multiple LVDS outputs buffer, if only partial outputs are used, it is
recommended to terminate the unused outputs.
Figure 4. Typical LVDS Driver Termination
3.3V
LVDS Driver
R1
100
–
+
3.3V
50
50
100
Differential Transmission Line
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PDF描述
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參數(shù)描述
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