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參數(shù)資料
| 型號(hào)： | ICS844003BG-01LFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 3/19頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC SYNTHESIZER 3LVDS 24-ETSSOP |
| 產(chǎn)品培訓(xùn)模塊： | PCI-Express |
| 標(biāo)準(zhǔn)包裝： | 2,500 |
| 系列： | HiPerClockS™, FemtoClock™ |
| 類型： | 頻率合成器 |
| PLL： | 帶旁路 |
| 輸入： | LVCMOS，LVTTL，晶體 |
| 輸出： | LVDS |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:3 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 680MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 24-TSSOP（0.173"，4.40mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 24-TSSOP |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 844003BG-01LFT |
ICS844003-01
FEMTOCLOCKSCRYSTAL-TO- LVDS FREQUENCY SYNTHESIZER
IDT / ICS LVDS FREQUENCY SYNTHESIZER
11
ICS844003BG-01 REV. A AUGUST 21, 2008
Parameter Measurement Information, continued
Offset Voltage Setup
Differential Output Voltage Setup
Application Information
Power Supply Filtering Technique
As in any high speed analog circuitry, the power supply pins are
vulnerable to random noise. To achieve optimum jitter perform-
ance, power supply isolation is required. The ICS844003-01
provides separate power supplies to isolate any high switching
noise from the outputs to the internal PLL. VDD, VDDA, VDDO_A and
VDDO_B should be individually connected to the power supply
plane through vias, and 0.01F bypass capacitors should be used
for each pin. Figure 1 illustrates this for a generic VDD pin and also
shows that VDDA requires that an additional 10 resistor along with
a 10
F bypass capacitor be connected to the V
DDA pin.
Figure 1. Power Supply Filtering
out
LVDS
DC Input
VOS/ VOS
V
DD
100
out
LVDS
DC Input
VOD/ VOD
V
DD
VDD
VDDA
3.3V
10
10F
.01F
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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