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參數(shù)資料
| 型號： | ICS2510CGT-CQ0 |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 5/7頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLOCK DVR PLL 3.3V 24-TSSOP |
| 標準包裝： | 2,500 |
| 類型： | 時鐘驅動器，扇出配送，擴展頻譜時鐘發(fā)生器 |
| PLL： | 帶旁路 |
| 輸入： | 時鐘 |
| 輸出： | CMOS |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:10 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 175MHz |
| 除法器/乘法器： | 無/無 |
| 電源電壓： | 2.97 V ~ 3.63 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 24-TSSOP（0.173"，4.40mm 寬） |
| 供應商設備封裝： | 24-TSSOP |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 2510CGT-CQ0 |
5
ICS2510C
0010G—09/22/09
PARAMETER MEASUREMENT INFORMATION
Figure 1. Load Circuit for Outputs
Notes:
1.
CL includes probe and jig capacitance.
2.
All input pulses are supplied by generators having the following
characteristics: PRR
≤133 MHz, ZO = 50 , Tr ≤1.2 ns, Tf ≤1.2 ns.
3.
The outputs are measured one at a time with one transition per measurement.
Figure 2. VoltageWaveforms
Propagation Delay Times
Figure 3. Phase Error and Skew Calculations
CLKIN
tPE (PHASE ERROR)
FBIN
FBOUT
tSK(o)
Any
CLKOUT
tSK(o)
Any
CLKOUT
Any
CLKOUT
From Output
Under Test
500
30pF
Input
Output
50% VCC
tR
tF
2V
0.4V
3V
0V
2V
0.4V
tPD
VOL
VOH
相關PDF資料 |
PDF描述 |
|---|---|
| ICS2510CGT | IC CLOCK DVR PLL 3.3V 24-TSSOP |
| ICS2510CGLFT | IC CLOCK DVR PLL 3.3V 24-TSSOP |
| MK3754DTR | IC VCXO/PLL CLK SYNTHESIZR 8SOIC |
| MK3754DLFTR | IC VCXO/PLL CLK SYNTHESIZR 8SOIC |
| MK1704ALFTR | IC CLK GENERATOR LOW EMI 8-SOIC |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| ICS251MI-XX | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:FIELD PROGRAMMABLE SS VERSACLOCK SYNTHESIZER |
| ICS251MI-XXLF | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:FIELD PROGRAMMABLE SS VERSACLOCK SYNTHESIZER |
| ICS251MI-XXLFT | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:FIELD PROGRAMMABLE SS VERSACLOCK SYNTHESIZER |
| ICS251MI-XXT | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:FIELD PROGRAMMABLE SS VERSACLOCK SYNTHESIZER |
| ICS251M-XX | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:FIELD PROGRAMMABLE SS VERSACLOCK SYNTHESIZER |
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