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參數(shù)資料
| 型號(hào)： | HYB25D256800AT-7 |
| 英文描述： | ?256Mbit (32Mx8) DDR266A (2-3-3)? |
| 中文描述： | ？的256Mbit（32Mx8）DDR266A（2-3-3）？ |
| 文件頁(yè)數(shù)： | 12/76頁(yè) |
| 文件大小： | 1218K |
| 代理商： | HYB25D256800AT-7 |
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HYB25D128400/800/160AT(L)
128-Mbit Double Data Rate SDRAM
Page 12 of 76
2002-05-06
Operating Mode
The normal operating mode is selected by issuing a Mode Register Set Command with bits A7-A11 set to
zero, and bits A0-A6 set to the desired values. A DLL reset is initiated by issuing a Mode Register Set com-
mand with bits A7 and A
9
-A11 each set to zero, bit A8 set to one, and bits A0-A6 set to the desired values. A
Mode Register Set command issued to reset the DLL should always be followed by a Mode Register Set
command to select normal operating mode.
All other combinations of values for A7-A11 are reserved for future use and/or test modes. Test modes and
reserved states should not be used as unknown operation or incompatibility with future versions may result.
Required CAS Latencies
N
OP
N
OP
N
OP
N
OP
N
OP
Read
CAS Latency = 2, BL = 4
Shown with nominal t
AC
, t
DQSCK
, and t
DQSQ
.
CK
CK
Command
DQS
DQ
Don’t Care
CL=2
N
OP
N
OP
N
OP
N
OP
N
OP
Read
CAS Latency = 2.5, BL = 4
CK
CK
Command
DQS
DQ
CL=2.5
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| HYB25D256800AT-7.5 | DDR Synchronous DRAM |
| HYB25D256800AT-8 | DDR Synchronous DRAM |
| HYB25D256800BC-7 | ?256Mb (64Mx4) FBGA DDR266A (2-3-3)? |
| HYB25D256800BT-5 | ?256Mbit (32Mx8) DDR400? |
| HYB25D256800BT-6 | ?256Mbit (32Mx8) DDR333 (2.5-3-3)? |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| HYB25D256800AT-7.5 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DDR Synchronous DRAM |
| HYB25D256800AT-8 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DDR Synchronous DRAM |
| HYB25D256800BC-6 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:256-Mbit Double Data Rate SDRAM, Die Rev. B |
| HYB25D256800BC-7 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:?256Mb (64Mx4) FBGA DDR266A (2-3-3)? |
| HYB25D256800BC-7F | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:256 Mbit Double Data Rate SDRAM |
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