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參數(shù)資料
| 型號： | HYB25D128400AT-8 |
| 英文描述： | ?128Mb (32Mx4) DDR200 (2-2-2)? |
| 中文描述： | ？128Mb的（32Mx4）DDR200（2-2-2）？ |
| 文件頁數(shù)： | 7/76頁 |
| 文件大?。?/td> | 1218K |
| 代理商： | HYB25D128400AT-8 |
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2002-05-06
Page 7 of 76
HYB25D128400/800/160AT(L)
128-Mbit Double Data Rate SDRAM
Block Diagram (8Mb x 16)
R
1
DQS
CK, CK
DLL
RAS
CAS
CK
CS
WE
CK
C
Column-Address
Counter/Latch
Mode
Registers
9
C
D
A0-A11,
BA0, BA1
CK
E
14
14
I/O
G
ating
DM Mask Logic
Array
(40
9
6 x 256x 32)
Sense Amplifiers
Bank1
Bank2
Bank3
12
8
1
2
2
R
16
16
16
RInput
1
1
1
1
1
32
32
2
32
clk
Data
Mask
Data
CK,
CK
COL0
COL0
COL0
clk
in
M
X
G
DQS
16
16
16
16
16
32
DQ0-DQ15,
DM
LDQS, UDQS
2
R
W
rite
F&
Drivers
Note:
This Functional Block Diagram is intended to facilitate user understanding of the operation of
the device; it does not represent an actual circuit implementation.
Note:
UDM and LDM are unidirectional signals (input only), but is internally loaded to match the
load of the bidirectional DQ , UDQS and LDQS signals.
Column
Decoder
(256
R
X
1
8
9
2
B
R
&
40
9
6
A
D
B
12
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| HYB25D128800AT-7 | ?128Mb (16mx8) DDR266A (2-3-3)? |
| HYB25D128800AT-8 | ?128Mb (16Mx8) DDR200 (2-2-2)? |
| HYB25D128800T-7 | ?128Mb (16Mx8) DDR 266A (2-3-3)? |
| HYB25D128800T-7.5 | ?128Mb (16Mx8) DDR 266B (2.5-3-3)? |
| HYB25D256160BT-8 | ?256Mbit (16Mx16) DDR200 (2-2-2)? |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| HYB25D128400ATL-6 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:128 Mbit Double Data Rate SDRAM |
| HYB25D128400ATL-7 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:128 Mbit Double Data Rate SDRAM |
| HYB25D128400ATL-8 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:128 Mbit Double Data Rate SDRAM |
| HYB25D128400C | 制造商:QIMONDA 制造商全稱:QIMONDA 功能描述:128-Mbit Double-Data-Rate SDRAM |
| HYB25D128400CC-6 | 制造商:QIMONDA 制造商全稱:QIMONDA 功能描述:128-Mbit Double-Data-Rate SDRAM |
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