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參數(shù)資料
| 型號： | HW-V5-ML501-UNI-G-J |
| 廠商： | Xilinx Inc |
| 文件頁數(shù)： | 4/91頁 |
| 文件大?。?/td> | 0K |
| 描述： | EVALUATION PLATFORM VIRTEX-5 |
| 標準包裝： | 1 |
| 系列： | Virtex®-5 LX |
| 類型： | FPGA |
| 適用于相關(guān)產(chǎn)品： | XC5VLX50FFG676 |
| 所含物品： | ML501 平臺、DVI 適配器和 CompactFlash 卡 |
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Virtex-5 FPGA Data Sheet: DC and Switching Characteristics
DS202 (v5.3) May 5, 2010
Product Specification
12
Table 21: Processor Block DCR Switching Characteristics
Clock Name
Description
Reference Clock
Speed Grade
Units
-3
-2
-1
Clock-to-out and setup relative to clock
TCK_CONTROL
CPMDCRCLK
TCK_ADDRESS
CPMDCRCLK
TCK_DATA
CPMDCRCLK
TCONTROL_CK
CPMDCRCLK
TADDRESS_CK
CPMDCRCLK
TDATA_CK
CPMDCRCLK
Table 22: Processor Block FCM Switching Characteristics
Clock Name
Description
Reference Clock
Speed Grade
Units
-3
-2
-1
Clock-to-out and setup relative to clock
TCK_CONTROL
CPMFCMCLK
0.967
1.084
1.324
ps
TCK_DATA
CPMFCMCLK
1.041
1.158
1.4
ps
TCK_INSTRUCTION
CPMFCMCLK
0.701
0.818
1.06
ps
TCONTROL_CK
CPMFCMCLK
1.057
1.218
1.395
ps
TDATA_CK
CPMFCMCLK
0.608
0.698
0.768
ps
TRESULT_CK
CPMFCMCLK
0.608
0.698
0.768
ps
Table 23: Processor Block MISC Switching Characteristics
Clock Name
Description
Reference Clock
Speed Grade
Units
-3
-2
-1
Clock-to-out and setup relative to clock
TCK_CONTROL
CLK1
TCK_ADDRESS
CLK2
TCK_DATA
CLK3
TCONTROL_CK
CLK4
TADDRESS_CK
CLK5
TDATA_CK
CLK6
相關(guān)PDF資料 |
PDF描述 |
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| R-729.0P | CONV DC/DC 2A 12-28VIN 9V |
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| R-729.0D | CONV DC/DC 2A 12-28VIN 9V |
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