參數(shù)資料
型號： HIP4086AP
廠商： INTERSIL CORP
元件分類： 功率晶體管
英文描述： 40000 SYSTEM GATE LOGIC CELL ARRAY - NOT RECOMMENDED for NEW DESIGN
中文描述： 1.1 A HALF BRDG BASED MOSFET DRIVER, PDIP24
封裝： PLASTIC, DIP-24
文件頁數(shù)： 6/9頁
文件大?。?/td> 75K
代理商： HIP4086AP
6
HIP4086
Timing Diagrams
FIGURE 1.
FIGURE 2. DISABLE FUNCTION
NOTES:
4. X means any “A”, “B”, or “C” phase.
5. With RDEL resistor tied to V
DD
, lowers and uppers cannot be turned on at the same time. Low side logic overrides high side logic unless RDEL
< 100mV.
XLI
XHI
XLO
XHO
XLO
XHO
DEAD TIME
DEAD TIME
(R
DEL
= V
SS
)
LOWER
TURN-OFF
LOWER
TURN-ON
UPPER
TURN-ON
UPPER
TURN-OFF
(R
DEL
= V
SS
)
DIS OR UV
XHI, XLI
XLO
XHO
DISABLE TO LOWER
TURN-ON PROP DELAY
DISABLE TURN-OFF
PROP DELAY (UPPERS)
DISABLE TO UPPER
ENABLE
REFRESH
PULSE WIDTH
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