參數(shù)資料
型號(hào)： HD49235FS
廠商： Hitachi,Ltd.
元件分類： 數(shù)字信號(hào)處理
英文描述： Digital Signal Processor for CD
中文描述： 數(shù)字信號(hào)處理器的CD
文件頁數(shù)： 9/41頁
文件大?。?/td> 192K
代理商： HD49235FS
HD49235FS
Rev.2, Aug. 1995, page 9 of 41
Register 9
0
1
D7
Illegal setting
Normal operation
BI1
D6
00: Normal play
01: Double-speed play
BI0
D5
10: Quadruple-speed play
11: Quadruple-speed play
WG10TL
D4
Sync detection window width: ±10 T
Sync detection window width: ±19 T
SYLCK1
D3
Length of time sync lock state is maintained when sync signal is missing
SYLCK0
D2
00: 2 frames
01: 4 frames
10: 8 frames
11: 12 frames
CRCQ
D1
QOK flag is not inserted in QDATA output QOK flag is inserted in QDATA output
Register A
0
1
MUTEL
D7
Left-channel mute off
Left-channel mute on
MUTER
D6
Right-channel mute off
Right-channel mute on
MONO
D5
Stereo
Monaural
ATT
D4
Attenuation off
Attenuation (–12 dB) on
BLGMAIN
D3
00: Stereo
01: Bilingual, right channel
BLGSUB
D2
10: Bilingual, left channel
11: Bilingual, left channel
SOFTMT
D1
Soft mute off
Soft mute on
SWLR
Notes: 1. Priority for mute and attenation as follows.
“Mute” port > SOFTMT > MUTE L, MUTE R > ATT
2. In the case of setting “ROM” = 1 (CD-ROM mode), the data of register “A” is ignored and is
considered all zero.
It is recovered as it were, after setting “ROM” = 0.
3. “BLGMAIN” and “BLG SUB” commands are ignored if “SWLR” = 1, and set stereo.
D0
Normal
Left-right reverse
Register B
D7
D6
D5
D4
D3
D2
D1
D0
Track counter setting
TC7
TC6
TC5
TC4
TC3
TC2
TC1
TC0
128
64
32
16
8
4
2
1
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PDF描述
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參數(shù)描述
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