t
參數(shù)資料
型號(hào)： EVAL-ADUC831QSZ
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 65/76頁(yè)
文件大?。?/td> 0K
描述： KIT DEV FOR ADUC831 QUICK START
產(chǎn)品培訓(xùn)模塊： Process Control
標(biāo)準(zhǔn)包裝： 1
系列： QuickStart™ 套件
類(lèi)型： MCU
適用于相關(guān)產(chǎn)品： ADuC831
所含物品： 評(píng)估板、電源、纜線、軟件和說(shuō)明文檔
產(chǎn)品目錄頁(yè)面： 739 (CN2011-ZH PDF)
相關(guān)產(chǎn)品： ADUC831BCPZ-ND - IC MCU 62K FLASH ADC/DAC 56LFCSP
ADUC831BCPZ-REEL-ND - IC MCU 62K FLASH ADC/DAC 56LFCSP
ADUC831BSZ-REEL-ND - IC MCU 62K FLASH ADC/DAC 52MQFP
ADUC831BSZ-ND - IC ADC/DAC 12BIT W/MCU 52-MQFP
其它名稱(chēng)： EVAL-ADUC831QS
EVAL-ADUC831QS-ND
REV. 0
–68–
ADuC831
12 MHz
Variable Clock
Parameter
Min
Max
Min
Max
Unit
Figure
EXTERNAL DATA MEMORY READ CYCLE
tRLRH
RD Pulsewidth
400
6tCK – 100
ns
71
tAVLL
Address Valid after ALE Low
43
tCK –40
ns
71
tLLAX
Address Hold after ALE Low
48
tCK –35
ns
71
tRLDV
RD Low to Valid Data In
252
5tCK – 165
ns
71
tRHDX
Data and Address Hold after
RD
00
ns
71
tRHDZ
Data Float after
RD
97
2tCK –70
ns
71
tLLDV
ALE Low to Valid Data In
517
8tCK – 150
ns
71
tAVDV
Address to Valid Data In
585
9tCK – 165
ns
71
tLLWL
ALE Low to
RD or WR Low
200
300
3tCK –50
3tCK +50
ns
71
tAVWL
Address Valid to
RD or WR Low
203
4tCK – 130
ns
71
tRLAZ
RD Low to Address Float
0
ns
71
tWHLH
RD or WR High to ALE High
43
123
tCK –40
6tCK – 100
ns
71
t
LLAX
DATA (IN)
MCLK
ALE (O)
PSEN (O)
PORT 0 (I/O)
PORT 2 (O)
RD (O)
t
LLDV
t
LLWL
t
AVWL
t
AVLL
t
AVDV
t
RLAZ
t
RLDV
t
RHDX
t
RHDZ
t
WHLH
A0–A7
(OUT)
A16–A23
A8–A15
t
RLRH
Figure 71. External Data Memory Read Cycle
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PDF描述
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