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參數(shù)資料
| 型號： | EVAL-AD5252EBZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 28/28頁 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL FOR AD5252 |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 主要目的： | 數(shù)字電位器 |
| 已用 IC / 零件： | AD5252 |
| 主要屬性： | 2 通道，256 位置 |
| 次要屬性： | I²C 接口 |
| 已供物品： | 板 |
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Data Sheet
AD5251/AD5252
Rev. D | Page 9 of 28
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS
1
2
3
4
5
6
7
AD0
WP
W1
SDA
A1
B1
VDD
14
13
12
11
10
9
8
B3
A3
AD1
VSS
SCL
DGND
W3
03823-0-002
AD5251/
AD5252
TOP VIEW
(Not to Scale)
Figure 2. Pin Configuration
Table 5. Pin Function Descriptions
Pin No.
Mnemonic
Description
1
V
DD
Positive Power Supply Pin. Connect +2.7 V to +5 V for single supply or ±2.7 V for dual supply, where
V
DD – VSS ≤ 5.5 V. VDD must be able to source 35 mA for 26 ms when storing data to EEMEM.
2
AD0
I2C Device Address 0. AD0 and AD1 allow four AD5251/AD5252 devices to be addressed.
3
WP
Write Protect, Active Low. V
WP ≤ VDD + 0.3 V.
4
W1
Wiper Terminal of RDAC1. V
5
B1
B Terminal of RDAC1. V
6
A1
A Terminal of RDAC1. V
7
SDA
Serial Data Input/Output Pin. Shifts in one bit at a time upon positive clock edges. MSB loaded first.
Open-drain MOSFET requires pull-up resistor.
8
V
SS
Negative Supply. Connect to 0 V for single supply or –2.7 V for dual supply, where V
DD – VSS ≤ +5.5 V. If
V
SS is used in dual supply, VSS must be able to sink 35 mA for 26 ms when storing data to EEMEM.
9
SCL
Serial Input Register Clock Pin. Shifts in one bit at a time upon positive clock edges. V
SCL ≤ (VDD + 0.3 V).
Pull-up resistor is recommended for SCL to ensure minimum power.
10
DGND
Digital Ground. Connect to system analog ground at a single point.
11
AD1
I2C Device Address 1. AD0 and AD1 allow four AD5251/AD5252 devices to be addressed.
12
A3
A Terminal of RDAC3. V
13
B3
B Terminal of RDAC3. V
14
W3
Wiper Terminal of RDAC3. V
1 For quad-channel device software compatibility, the dual potentiometers in the parts are designated as RDAC1 and RDAC3.
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