參數(shù)資料
型號(hào)： EVAL-AD1940AZ
廠商： Analog Devices Inc
文件頁數(shù)： 20/36頁
文件大?。?/td> 0K
描述： BOARD EVAL AD1940 SIGMADSP
標(biāo)準(zhǔn)包裝： 1
系列： SigmaDSP®
主要目的： 音頻，音頻處理
嵌入式： 是，DSP
已用 IC / 零件： AD1940
主要屬性： 單芯片多通道 28/56 位音頻 DSP
次要屬性： 均衡，交叉，低音增強(qiáng)，多頻帶動(dòng)態(tài)處理，延遲等
已供物品： 板
AD1940/AD1941
Rev. B | Page 27 of
36
Table 32. Data Capture Register Write Format
Byte 0
Byte 1
Byte 2
Byte 3
Byte 4
chip_adr [6:0], W/R
0000, data_capture_adr [11:8]
data_capture_adr [7:0]
000, progcount [10:6]1
progcount [5:0]1, regsel [1:0]2
1 Progcount [10:0] = value of program counter where trap occurs (the table of values is generated by the program compiler).
2 Regsel [1:0] selects one of four registers (see Data Capture Registers section).
Table 33. Data Capture (Control Port Readback) Register Read Format
Byte 0
Byte 1
Byte 2
Bytes 3–5
chip_adr [6:0], W/R
0000, data_capture_adr [11:8]
data_capture_adr [7:0]
data [23:0]
Table 34. Safeload Register Data Write Format
Byte 0
Byte 1
Byte 2
Byte 3
Bytes 4–7
chip_adr [6:0], W/R
0000, safeload_adr [11:8]
safeload_adr [7:0]
000000, data [33:32]
data [31:0]
Table 35. Safeload Register Address Write Format
Byte 0
Byte 1
Byte 2
Byte 3
Byte 4
chip_adr [6:0], W/R
0000, safeload_adr [11:8]
safeload_adr [7:0]
000000, param_adr [9:8]
param_adr [7:0]
相關(guān)PDF資料
PDF描述
6278128-6 MT-RJ/MT-RJ 6M1 C/A
1-1906054-0 CA 2MM OFNR 62.5/125,LC SEC GRE
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VE-20J-EX CONVERTER MOD DC/DC 36V 75W
RNF-100-1-GY-SP HEAT SHRINK TUBING
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參數(shù)描述
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