參數(shù)資料
型號： EPM7128AETI144-7N
廠商： Altera
文件頁數(shù)： 44/64頁
文件大?。?/td> 0K
描述： IC MAX 7000 CPLD 128 144-TQFP
產(chǎn)品變化通告： Bond Wire Change 4/Sept/2008
標準包裝： 180
系列： MAX® 7000A
可編程類型： 系統(tǒng)內(nèi)可編程
最大延遲時間 tpd(1)： 7.5ns
電壓電源 - 內(nèi)部： 3 V ~ 3.6 V
邏輯元件/邏輯塊數(shù)目： 8
宏單元數(shù)： 128
門數(shù)： 2500
輸入/輸出數(shù)： 100
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 144-LQFP
供應商設(shè)備封裝： 144-TQFP（20x20）
包裝： 托盤
其它名稱： 544-2587
EPM7128AETI144-7N-ND
Altera Corporation
49
MAX 7000A Programmable Logic Device Data Sheet
Table 27. EPM7128A External Timing Parameters
Symbol
Parameter
Conditions
Speed Grade
Unit
-6
-7
-10
-12
MinMax
tPD1
Input to non-registered
output
C1 = 35 pF
6.0
7.5
10.0
12.0
ns
tPD2
I/O input to non-
registered output
C1 = 35 pF
6.0
7.5
10.0
12.0
ns
tSU
Global clock setup time
4.2
5.3
7.0
8.5
ns
tH
Global clock hold time
0.0
ns
tFSU
Global clock setup time
of fast input
2.5
3.0
ns
tFH
Global clock hold time of
fast input
0.0
ns
tCO1
Global clock to output
delay
C1 = 35 pF
1.0
3.7
1.0
4.6
1.0
6.1
1.0
7.3
ns
tCH
Global clock high time
3.0
4.0
5.0
ns
tCL
Global clock low time
3.0
4.0
5.0
ns
tASU
Array clock setup time
1.9
2.4
3.1
3.8
ns
tAH
Array clock hold time
1.5
2.2
3.3
4.3
ns
tACO1
Array clock to output
delay
C1 = 35 pF
1.0
6.0
1.0
7.5
1.0
10.0
1.0
12.0
ns
tACH
Array clock high time
3.0
4.0
5.0
ns
tACL
Array clock low time
3.0
4.0
5.0
ns
tCPPW
Minimum pulse width for
clear and preset
3.0
4.0
5.0
ns
tCNT
Minimum global clock
period
6.9
8.6
11.5
13.8
ns
fCNT
Maximum internal global
clock frequency
144.9
116.3
87.0
72.5
MHz
tACNT
Minimum array clock
period
6.9
8.6
11.5
13.8
ns
fACNT
Maximum internal array
clock frequency
144.9
116.3
87
72.5
MHz
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EPM7128AFC100-6 制造商:Rochester Electronics LLC 功能描述:- Bulk
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