參數資料
型號： EPCS4SI8N
廠商： Altera
文件頁數： 24/40頁
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描述： IC CONFIG DEVICE 4MBIT 8-SOIC
產品培訓模塊： Three Reasons to Use FPGA's in Industrial Designs
標準包裝： 100
系列： EPCS
可編程類型： 系統內可編程
存儲容量： 4Mb
電源電壓： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
封裝/外殼： 8-SOIC（0.154"，3.90mm 寬）
供應商設備封裝： 8-SOIC
包裝： 管件
產品目錄頁面： 604 (CN2011-ZH PDF)
其它名稱： 544-1379-5
EPCS4SI8N-ND
Page 30
Timing Information
Serial Configuration (EPCS) Devices Datasheet
January 2014
Altera Corporation
Figure 19 shows the timing waveform for the read operation of the EPCS device.
Table 17 lists the EPCS device timing parameters for the read operation.
1 Existing batches of EPCS1 and EPCS4 devices manufactured on 0.15 m process
geometry support the AS configuration up to 40 MHz. However, batches of EPCS1
and EPCS4 devices manufactured on 0.18 m process geometry support the AS
configuration only up to 20 MHz. EPCS16, EPCS64, and EPCS128 devices are not
affected.
f For more information about product traceability and transition date to differentiate
between 0.15 m process geometry and 0.18 m process geometry of the EPCS1 and
Figure 19. Read Operation Timing Diagram
nCS
DCLK
DATA
ASDI
tnCLK2D
tCL
tCH
tODIS
Bit N
Bit 0
Bit N
1
Add_Bit 0
Table 17. Read Operation Parameters
Symbol
Parameter
Min
Max
Unit
fRCLK
Read clock frequency (from the FPGA or
embedded processor) for the read bytes
operation
—20
MHz
Fast read clock frequency (from the FPGA or
embedded processor) for the fast read bytes
operation
—40
MHz
tCH
DCLK
high time
11
—
ns
tCL
DCLK
low time
11
—
ns
tODIS
Output disable time after read
—
8
ns
tnCLK2D
Clock falling edge to DATA
—8
ns
相關PDF資料
PDF描述
GRM2165C2A111JA01D CAP CER 110PF 100V 5% NP0 0805
RCB92DHRR-S330 EDGECARD EXT PCI 184PS .050 3.3V
FMC18DREH CONN EDGECARD 36POS .100 EYELET
1250L4 BATTERY PK S-HD 6.0V D SIZE ZINC
EPC1PC8 IC CONFIG DEVICE 1MBIT 8-DIP
相關代理商/技術參數
參數描述
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EPCSC2.5T1-2 功能描述:接線端子工具和配件 End Plate RoHS:否 制造商:Phoenix Contact 產品:Tools & Accessories 類型:End Bracket
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