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參數資料
| 型號： | EP1K50TI144-2X |
| 英文描述： | Field Programmable Gate Array (FPGA) |
| 中文描述： | 現(xiàn)場可編程門陣列（FPGA） |
| 文件頁數： | 28/86頁 |
| 文件大?。?/td> | 1263K |
| 代理商： | EP1K50TI144-2X |
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34
Altera Corporation
ACEX 1K Programmable Logic Device Family Data Sheet
Column-to-IOE Connections
When an IOE is used as an input, it can drive up to two separate column
channels. When an IOE is used as an output, the signal is driven by a
multiplexer that selects a signal from the column channels. Two IOEs
connect to each side of the column channels. Each IOE can be driven by
column channels via a multiplexer. The set of column channels is different
for each IOE (see Figure 17).
Figure 17. ACEX 1K Column-to-IOE Connections
Note:
(1)
The values for m and n are shown in Table 9.
Table 9 lists the ACEX 1K column-to-IOE interconnect resources.
Table 9. ACEX 1K Column-to-IOE Interconnect Resources
Device
Channels per Column (n)
Column Channels per Pin (m)
EP1K10
24
16
EP1K30
24
16
EP1K50
24
16
EP1K100
24
16
Each IOE is driven by
a m-to-1 multiplexer
Each IOE can drive two
column channels.
Column
Interconnect
n
m
n
IOE1
相關PDF資料 |
PDF描述 |
|---|---|
| EP1K50TI144-3F | Field Programmable Gate Array (FPGA) |
| EP20K100RC208-1 | High Power LED Driver; Temperature Range: -25°C to 85°C; Package: 20-QFN |
| EP20K100RC208-1ES | High Power LED Driver; Temperature Range: -25°C to 85°C; Package: 20-QFN T&R |
| EP20K100RC208-2 | Advanced 170MHz Triple Video Digitizer with Digital PLL; Temperature Range: 0°C to 70°C; Package: 128-MQFP |
| EP20K100RC208-2ES | Advanced 240MHz Triple Video Digitizer with Digital PLL; Temperature Range: 0°C to 70°C; Package: 128-MQFP |
相關代理商/技術參數 |
參數描述 |
|---|---|
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| EP1M120F484C6 | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - MERCURY 480 LABs 303 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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