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參數(shù)資料
| 型號： | EP1K50FI484-1X |
| 英文描述： | Field Programmable Gate Array (FPGA) |
| 中文描述： | 現(xiàn)場可編程門陣列（FPGA） |
| 文件頁數(shù)： | 61/86頁 |
| 文件大小： | 1263K |
| 代理商： | EP1K50FI484-1X |
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64
Altera Corporation
ACEX 1K Programmable Logic Device Family Data Sheet
Table 34. EP1K10 Device Interconnect Timing Microparameters
Note (1), (2)
Symbol
Speed Grade
Unit
-1
-2
-3
Min
Max
Min
Max
Min
Max
tDIN2IOE
2.3
2.7
3.6
ns
tDIN2LE
0.8
1.1
1.4
ns
tDIN2DATA
1.1
1.4
1.8
ns
tDCLK2IOE
2.3
2.7
3.6
ns
tDCLK2LE
0.8
1.1
1.4
ns
tSAMELAB
0.1
0.2
ns
tSAMEROW
1.8
2.1
2.9
ns
tSAMECOLUMN
0.3
0.4
0.7
ns
tDIFFROW
2.1
2.5
3.6
ns
tTWOROWS
3.9
4.6
6.5
ns
tLEPERIPH
3.3
3.7
4.8
ns
tLABCARRY
0.3
0.4
0.5
ns
tLABCASC
0.9
1.0
1.4
ns
Table 35. EP1K10 External Timing Parameters
Symbol
Speed Grade
Unit
-1
-2
-3
Min
Max
Min
Max
Min
Max
tDRR
7.5
9.5
12.5
ns
tINSU (3), (4)
2.4
2.7
3.6
ns
tINH (3), (4)
0.0
ns
tOUTCO (3), (4)
2.0
6.6
2.0
7.8
2.0
9.6
ns
tINSU (5), (4)
1.4
1.7
–
ns
tINH (5), (4)
0.5
5.1
0.5
6.4
–
ns
tOUTCO (5), (4)
0.0
–
ns
tPCISU (4)
3.0
4.2
6.4
ns
tPCIH (4)
0.0
–
ns
tPCICO (4)
2.0
6.0
2.0
7.5
2.0
10.2
ns
相關PDF資料 |
PDF描述 |
|---|---|
| EP1K50FI484-2DX | Field Programmable Gate Array (FPGA) |
| EP1K50FI484-2F | Field Programmable Gate Array (FPGA) |
| EP1K50FI484-2P | Field Programmable Gate Array (FPGA) |
| EP1K50FI484-2X | Field Programmable Gate Array (FPGA) |
| EP1K50FI484-3F | Field Programmable Gate Array (FPGA) |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| EP1K50FI484-2 | 制造商:Rochester Electronics LLC 功能描述:- Bulk 制造商:Altera Corporation 功能描述: |
| EP1K50FI484-2DX | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
| EP1K50FI484-2F | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
| EP1K50FI484-2P | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
| EP1K50FI484-2X | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
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