參數(shù)資料
型號(hào)： EMBEDDEDPROCESSOR
英文描述： Single Event Hardened High-Speed, Dual Output PWM; Temperature Range: QML Class Q; Package: 16-SBDIP
中文描述： 嵌入式處理器-的AMD - K6 - 2E號(hào)嵌入式處理器數(shù)據(jù)手冊(cè)
文件頁(yè)數(shù)： 39/368頁(yè)
文件大小： 5669K
代理商： EMBEDDEDPROCESSOR
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Chapter 5
Signal Descriptions
111
23542A/0—September 2000
AMD-K6-2E+ Embedded Processor Data Sheet
Preliminary Information
5.22
FERR# (Floating-Point Error)
Pin Attribute
Output
Summary
The assertion of FERR # indicates the occurrence of an
unmaske d fl oa ting-point excepti on re sul ting from the
execution of a floating-point instruction. This signal is provided
to allow the system logic to handle this exception in a manner
consistent with IBM-compatible PC/AT systems. See “Handling
implementation that supports floating-point exceptions.
The state of the numeric error (NE) bit in CR0 does not affect
the FERR# signal.
The processor is designed so that FERR # does not glitch,
enabling the signal to be used as a clocking source for system
logic.
Driven
The processor asserts FERR # on the instruction boundary of
the next floating-point instruction, MMX instruction, 3DNow!
instruction, or WAIT instruction that occurs following the
f l oa ti n g -p oi n t i n st r u ct i o n tha t ca us e d t h e unm as ke d
floating-point exception—that is, FERR# is not asserted at the
time the exception occurs. The IGNNE # signal does not affect
the assertion of FERR #.
FERR # is negated during the following conditions:
s
Following the successful execution of the floating-point
instructions FCLEX, FINIT, FSAVE, and FSTENV
s
Under certain circumstances, following the successful
execution
of
the
floating-point
instructions
FLDCW,
FLDENV, and FRSTOR, which load the floating-point status
word or the floating-point control word
s
Following the falling transition of RESET
FERR # is always driven except in the Three-State Test mode.
more details on floating-point exceptions.
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PDF描述
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