參數(shù)資料
型號： DS2164Q
廠商： DALLAS SEMICONDUCTOR
元件分類： Codec
英文描述： A/MU-LAW, ADPCM CODEC, PQCC28
封裝： PLASTIC, LCC-28
文件頁數(shù)： 6/17頁
文件大?。?/td> 304K
代理商： DS2164Q
DS2164Q
14 of 17
PCM INTERFACE
AC ELECTRICAL CHARACTERISTICS
(0
°C to 70°C; V
DD=5V
≤ 10%)
PARAMETER
SYMBOL
MIN
TYP
MAX
UNITS
NOTES
CLKX, CLKY Period
tPXY
244
3906
ns
1
CLKX, CLKY Pulse Width
tWXYL
tWXYH
100
ns
CLKX, CLKY Rise Fall Times
tRXY
tFXY
10
20
ns
Hold Time from CLKX, CLKY to FSX,
FSY
tHOLD
0ns
2
Setup Time from FSX, FSY High to
CLKX, CLKY Low
tSF
50
ns
2
Hold Time from CLKX, CLKY Low to
FSX, FSY Low
tHF
100
ns
2
Setup Time for XIN, YIN to CLKX,
CLKY Low
tSD
50
ns
2
Hold Time for XIN, YIN to CLKX,
CLKY Low
tHD
50
ns
2
Delay Time from CLKX, CLKY to
Valid XOUT, YOUT
tDXYO
10
150
ns
3
Delay Time from CLKX, CLKY to
XOUT, YOUT 3-stated
tDXYZ
20
150
ns
2, 3, 4
NOTES:
1. Maximum width of FSX and FSY is one CLKX or CLKY period (except for signaling frames).
2. Measured at VIH = 2.0V, VIL = 0.8V, and 10 ns maximum rise and fall times.
3. Load = 150 pF + 2 LSTTL loads.
4. For LSB of PCM or ADPCM byte.
MASTER CLOCK / RESET
AC ELECTRICAL CHARACTERISTICS
(0°C to 70°C; VDD=5V
≤ 10%)
PARAMETER
SYMBOL
MIN
TYP
MAX
UNITS
NOTES
MCLK Period
tPM
100
ns
1
MCLK Pulse Width
tWMH,
tWML
45
50
55
ns
MCLK Rise/Fall Times
tRM, tFM
10
ns
RST
Pulse Width
tRST
1ms
NOTE:
1. MCLK = 10 MHz
≤ 500 ppm
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PDF描述
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DS2164Q+T&R 制造商:Maxim Integrated Products 功能描述:ADPCM PROCESSOR 28PLCC - Tape and Reel
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