參數資料
型號： DS2164Q
廠商： DALLAS SEMICONDUCTOR
元件分類： Codec
英文描述： A/MU-LAW, ADPCM CODEC, PQCC28
封裝： PLASTIC, LCC-28
文件頁數： 14/17頁
文件大?。?/td> 304K
代理商： DS2164Q
DS2164Q
6 of 17
ALGORITHM SELECT BITS Table 2
ALGORITHM SELECTED
AS2
AS1
AS0
64kbps to/from 32 kbps
0
64kbps to/from 24 kbps
1
64kbps to/from 16 kbps
1
0
1
INPUT TIME SLOT REGISTER Figure 5
(MSB)
(LSB)
-
D5
D4
D3
D2
D1
D0
SYMBOL
POSITION
NAME AND DESCRIPTION
-
ITR.7
Reserved; must be 0 for proper operation.
-
ITR.6
Reserved; must be 0 for proper operation.
D5
ITR.5
MSB of input time slot register.
D4
ITR.4
D3
ITR.3
D2
ITR.2
D1
ITR.1
D0
ITR.0
LSB of input time slot register.
OUTPUT TIME SLOT REGISTER Figure 6
(MSB)
(LSB)
-
D5
D4
D3
D2
D1
D0
SYMBOL
POSITION
NAME AND DESCRIPTION
-
OTR.7
Reserved; must be 0 for proper operation.
-
OTR.6
Reserved; must be 0 for proper operation.
D5
OTR.5
MSB of output time slot register.
D4
OTR.4
D3
OTR.3
D2
OTR.2
D1
OTR.1
D0
OTR.0
LSB of output time slot register.
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PDF描述
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