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參數(shù)資料
| 型號： | CS96100-CM |
| 英文描述： | Consumer IC |
| 中文描述： | 消費(fèi)性IC |
| 文件頁數(shù)： | 8/58頁 |
| 文件大?。?/td> | 1099K |
| 代理商： | CS96100-CM |
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CS98100
8
1.2.2
The CS98100 interfaces with either SDRAM or SGRAM, for high data bandwidth transfer.
Figure 5
and
Table 2
show the interface pin timing.
Figure 2
shows the refresh cycle performed by the CS98100.
Figure 3
shows a burst read (length = 8) transaction, while
Figure 4
shows a burst write (length=8) trans-
action. In both
Figure 3
and
Figure 4
, CAS latency is programmed to 3.
SDRAM Interface
Symbol
tmco
tmper
tmdow
tmhw
tmsur
tmhr
Description
Min
Typ
Max
8.5
Unit
ns
ns
ns
ns
ns
ns
Output Delay from DR_CKO active edge
DR_CKO Period
DR_D[31:0] delay from DR_CKO
DR_D[31:0] valid time after DR_CKO
DR_D[31:0] setup to DR_CKO
DR_D[31:0] hold time after DR_CKO
10.5
12.2
8.5
1.5
2.5
0
Table 2. SDRAM Interface Characteristics
DR_CKO
DR_A[11:0]
DR_BS_N
DR_RAS_N
DR_CAS_N
DR_WE_N
DR_D[31:0]
DR_DQM_[3:0]
DR_AP
Figure 2. SDRAM Refresh Transaction
相關(guān)PDF資料 |
PDF描述 |
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