SWITCHING SPECIFICATIONS - CONTROL PORT INTERFACE (Continued) Notes" />
參數(shù)資料
型號： CS4341A-KSZ
廠商： Cirrus Logic Inc
文件頁數(shù)： 25/34頁
文件大小： 0K
描述： IC DAC STER 24BIT 192KHZ 16SOIC
標(biāo)準(zhǔn)包裝： 48
位數(shù)： 24
數(shù)據(jù)接口： 串行
轉(zhuǎn)換器數(shù)目： 2
電壓電源： 單電源
功率耗散（最大）： 90mW
工作溫度： -10°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 16-SOIC（0.154"，3.90mm 寬）
供應(yīng)商設(shè)備封裝： 16-SOIC
包裝： 托盤
輸出數(shù)目和類型： 2 電壓，單極
采樣率（每秒）： 192k
產(chǎn)品目錄頁面： 756 (CN2011-ZH PDF)
其它名稱： 598-1633
CS4341A
DS582F2
31
SWITCHING SPECIFICATIONS - CONTROL PORT INTERFACE (Continued)
Notes: 9. tspi only needed before first falling edge of CS after RST rising edge. tspi = 0 at all other times.
10. Data must be held for sufficient time to bridge the transition time of CCLK.
11. For fsclk < 1 MHz.
Parameter
Symbol
Min
Max
Unit
SPI Mode
CCLK Clock Frequency
fsclk
-6
MHz
RST Rising Edge to CS Falling
tsrs
500
-
ns
CCLK Edge to CS Falling
(Note 9)
tspi
500
-
ns
CS High Time Between Transmissions
tcsh
1.0
-
s
CS Falling to CCLK Edge
tcss
20
-
ns
CCLK Low Time
tscl
66
-
ns
CCLK High Time
tsch
66
-
ns
CDIN to CCLK Rising Setup Time
tdsu
40
-
ns
CCLK Rising to DATA Hold Time
(Note 10)
tdh
15
-
ns
Rise Time of CCLK and CDIN
(Note 11)
tr2
-100
ns
Fall Time of CCLK and CDIN
(Note 11)
tf2
-100
ns
t r2
t f2
t dsu t dh
t sch
t scl
CS
CC L K
CD IN
t css
t csh
t spi
t srs
RST
Figure 20. Control Port Timing - SPI Mode
相關(guān)PDF資料
PDF描述
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相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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CS4341-CZZR 功能描述:數(shù)模轉(zhuǎn)換器- DAC IC 24bit 96kHz 101dB Stereo DAC w/VC RoHS:否 制造商:Texas Instruments 轉(zhuǎn)換器數(shù)量:1 DAC 輸出端數(shù)量:1 轉(zhuǎn)換速率:2 MSPs 分辨率:16 bit 接口類型:QSPI, SPI, Serial (3-Wire, Microwire) 穩(wěn)定時間:1 us 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:SOIC-14 封裝:Tube
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