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參數(shù)資料
| 型號(hào)： | CD4042BMS |
| 廠(chǎng)商： | Intersil Corporation |
| 英文描述： | CMOS Quad Clocked D Latch(CMOS 四路時(shí)鐘鎖存器) |
| 中文描述： | 的CMOS四時(shí)鐘D鎖存器（的CMOS四路時(shí)鐘鎖存器） |
| 文件頁(yè)數(shù)： | 8/8頁(yè) |
| 文件大?。?/td> | 63K |
| 代理商： | CD4042BMS |
7-875
CD4042BMS
FIGURE 7. TYPICAL PROPAGATION DELAY TIME vs LOAD
CAPACITANCE - CLOCK TO Q
FIGURE 8. TYPICAL PROPAGATION DELAY TIME vs LOAD
CAPACITANCE - CLOCK TO Q
FIGURE 9. TYPICAL POWER DISSIPATION vs FREQUENCY
FIGURE 10. TYPICAL TRANSITION TIME vs LOAD CAPACI-
TANCE
Chip Dimensions and Pad Layout
Typical Performance Characteristics
(Continued)
AMBIENT TEMPERATURE (T
A
) = +25
o
C
10V
SUPPLY VOLTAGE (VDD) = 5V
P
150
100
50
0
20
40
60
80
LOAD CAPACITANCE (CL) (pF)
15V
200
250
300
100
120
140
AMBIENT TEMPERATURE (T
A
) = +25
o
C
SUPPLY VOLTAGE (VDD) = 5V
P
150
100
50
0
20
40
60
80
LOAD CAPACITANCE (CL) (pF)
15V
200
250
300
100
120
140
10V
10V
5V
10V
AMBIENT TEMPERATURE (T
A
) = +25
o
C
SUPPLY VOLTAGE (VDD) = 15V
CL = 15pF
CL = 50pF
INPUT FREQUENCY (fI) (kHz)
10
3
10
4
10
5
10
6
10
7
10
5
10
3
10
1
10
6
P
μ
W
10
2
10
4
AMBIENT TEMPERATURE (T
A
) = +25
o
C
LOAD CAPACITANCE (CL) (pF)
0
40
60
80
100
20
0
50
100
150
200
SUPPLY VOLTAGE (VDD) = 5V
10V
15V
T
FIGURE 11. DYNAMIC TEST PARAMETERS
t
S
t
H
tPHL, tPLH
D TO Q OR Q
tPHL, tPLH
CL TO Q OR Q
CLOCK
CL
DATA
INPUT
D
Q
OUTPUT
NOTES:
1. For positive clock edge, input data is
latched when polarity is low.
2. For negative clock edge, input data is
latched when polarity is high.
NOTE 1
NOTE 2
LATCH
LOW DATA
LATCH
HIGH DATA
LOW DATA
LATCHED
HIGH DATA
LATCHED
Dimensions in parentheses are in millimeters and are
derived from the basic inch dimensions as indicated
Grid graduations are in mils (10
inch).
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CD4043BMS | CMOS Quad 3 State R/S Latches(CMOS四 R/S鎖存器（三態(tài)）) |
| CD4044BC | Quad 3-STATE NAND R/S Latches(四3態(tài)輸入與非邏輯R/S緩沖器) |
| CD4044BPW | Single 100Mbps Digital Isolator with Enable 8-SOIC -40 to 125 |
| CD4044BDWR | Single 100Mbps Digital Isolator 8-SOIC -40 to 125 |
| CD4043BPW | CMOS QUAD 3-STATE R/S LATCHES |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CD4042BNS | 制造商:Texas Instruments 功能描述: |
| CD4042BNSR | 功能描述:閉鎖 CMOS Quad Clocked ’D’ Latch RoHS:否 制造商:Micrel 電路數(shù)量:1 邏輯類(lèi)型:CMOS 邏輯系列:TTL 極性:Non-Inverting 輸出線(xiàn)路數(shù)量:9 高電平輸出電流: 低電平輸出電流: 傳播延遲時(shí)間: 電源電壓-最大:12 V 電源電壓-最小:5 V 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:SOIC-16 封裝:Reel |
| CD4042BNSRE4 | 功能描述:閉鎖 CMOS Quad Clocked ’D’ Latch RoHS:否 制造商:Micrel 電路數(shù)量:1 邏輯類(lèi)型:CMOS 邏輯系列:TTL 極性:Non-Inverting 輸出線(xiàn)路數(shù)量:9 高電平輸出電流: 低電平輸出電流: 傳播延遲時(shí)間: 電源電壓-最大:12 V 電源電壓-最小:5 V 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:SOIC-16 封裝:Reel |
| CD4042BNSRG4 | 功能描述:閉鎖 CMOS Quad Clocked ’D’ Latch RoHS:否 制造商:Micrel 電路數(shù)量:1 邏輯類(lèi)型:CMOS 邏輯系列:TTL 極性:Non-Inverting 輸出線(xiàn)路數(shù)量:9 高電平輸出電流: 低電平輸出電流: 傳播延遲時(shí)間: 電源電壓-最大:12 V 電源電壓-最小:5 V 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:SOIC-16 封裝:Reel |
| CD4042BPW | 功能描述:閉鎖 CMOS Quad Clocked ’D’ Latch RoHS:否 制造商:Micrel 電路數(shù)量:1 邏輯類(lèi)型:CMOS 邏輯系列:TTL 極性:Non-Inverting 輸出線(xiàn)路數(shù)量:9 高電平輸出電流: 低電平輸出電流: 傳播延遲時(shí)間: 電源電壓-最大:12 V 電源電壓-最小:5 V 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:SOIC-16 封裝:Reel |
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