參數(shù)資料
型號(hào)： AM79C973VCW
廠商： ADVANCED MICRO DEVICES INC
元件分類： 微控制器/微處理器
英文描述： PCnet⑩-FAST III Single-Chip 10/100 Mbps PCI Ethernet Controller with Integrated PHY
中文描述： 5 CHANNEL(S), 10M bps, LOCAL AREA NETWORK CONTROLLER, PQFP176
封裝： TQFP-176
文件頁(yè)數(shù)： 186/304頁(yè)
文件大?。?/td> 2092K
代理商： AM79C973VCW
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186
Am79C973/Am79C975
P R E L I M I N A R Y
Read/Write accessible always.
APEP is set to 0 during
H_RESET and is unaffected by
S_RESET and the STOP bit.
10-8
APDW
Auto-Poll Dwell Time. APDW de-
termines the dwell time between
PHY
Management
accesses when Auto-Poll is
turned on. See Table 38.
Frame
Read/Write accessible always.
APDW is set to 100h after
H_RESET and is unaffected by
S_RESET and the STOP bit.
7
DANAS
Disable Auto-Negotiation Auto
Setup. When DANAS is set, the
Am79C973/Am79C975 controller
after a H_RESET or S_RESET
will remain dormant and not auto-
matically startup the Auto-Negoti-
ation section or the enhanced
automatic port selection section.
Instead,
the
Am79C975 controller will wait for
the software driver to setup the
Auto-Negotiation portions of the
device. The PHY Address and
Data programming in BCR33 and
BCR34
is
still
Am79C973/Am79C975 controller
will not generate any manage-
ment frames unless Auto-Poll is
enabled.
Am79C973/
valid.
The
Read/write accessible always.
DANAS is set to 0 by H_RESET
and is unaffected by S_RESET
and the STOP bit.
6
XPHYRST
PHY Reset. When XPHYRST is
set, the Am79C973/Am79C975
controller after an H_RESET or
S_RESET will issue manage-
ment frames that will reset the
PHY. This bit is needed when
there is no way to guarantee the
state of the external PHY. This bit
must be reprogrammed after ev-
ery H_RESET.
Read/Write accessible always.
XPHYRST is set to 0 by
H_RESET and is unaffected by
S_RESET and the STOP bit.
XPHYRST is only valid when the
internal Network Port Manager is
scanning for a network port.
5
XPHYANE
PHY Auto-Negotiation Enable.
This bit will force the PHY into en-
abling Auto-Negotiation. When
set
to
0
the
Am79C975 controller will send a
management
frame disabling
Auto-Negotiation.
Am79C973/
Read/Write accessible always.
XPHYANE is set to 0 by
H_RESET and is unaffected by
S_RESET and the STOP bit.
XPHYANE is only valid when the
internal Network Port Manager is
scanning for a network port.
4
XPHYFD
PHY Full Duplex. When set, this
bit will force the PHY into full du-
plex when Auto-Negotiation is not
enabled.
Read/Write accessible always.
XPHYFD
is
set
H_RESET, and is unaffected by
S_RESET and the STOP bit.
to
0
by
3
XPHYSP
PHY Speed. When set, this bit
will force the PHY into 100 Mbps
mode when Auto-Negotiation is
not enabled.
Read/Write accessible always.
XPHYSP
is
set
H_RESET, and is unaffected by
S_RESET and the STOP bit.
to
0
by
2
RES
Reserved location. Written as ze-
ros and read as undefined.
1
MIIILP
Media Independent Interface In-
ternal Loopback. When set, this
bit will cause the internal portion
of the MII data port to loopback
on itself. The interface is mapped
in
the
following
way.
The
Table 38. APDW Values
Auto-Poll
Dwell Time
Continuous (26
μ
s @ 2.5 MHz)
Every 128 MDC cycles (103
μ
s @ 2.5 MHz)
Every 256 MDC cycles (206
μ
s @ 2.5 MHz)
Every 512 MDC cycles (410
μ
s @ 2.5 MHz)
Every 1024 MDC cycles (819
μ
s @ 2.5 MHz)
Every 2048 MDC cycles (1640
μ
s @ 2.5 MHz)
110-111
Reserved
APDW
000
001
010
011
100
101
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PDF描述
AM79C975VCW PCnet⑩-FAST III Single-Chip 10/100 Mbps PCI Ethernet Controller with Integrated PHY
AM79C976 PCnet-PRO⑩ 10/100 Mbps PCI Ethernet Controller
AM79C976KIW PCnet-PRO⑩ 10/100 Mbps PCI Ethernet Controller
AM79C976KCW PCnet-PRO⑩ 10/100 Mbps PCI Ethernet Controller
AM79C978AKCW Single-Chip 1/10 Mbps PCI Home Networking Controller
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參數(shù)描述
AM79C974 制造商:AMD 制造商全稱:Advanced Micro Devices 功能描述:PCnetTM-SCSI Combination Ethernet and SCSI Controller for PCI Systems
AM79C974KC 制造商:Advanced Micro Devices 功能描述:
AM79C974KC/W 制造商:未知廠家 制造商全稱:未知廠家 功能描述:LAN Node Controller
AM79C974KCW 制造商:AMD 制造商全稱:Advanced Micro Devices 功能描述:PCnetTM-SCSI Combination Ethernet and SCSI Controller for PCI Systems
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