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參數(shù)資料
| 型號(hào)： | AK4380VT |
| 廠商： | Asahi Kasei Microsystems Co.,Ltd |
| 英文描述： | 100dB 24BIT 96kHz 2CH DAC |
| 中文描述： | 100dB的24位96kHz的2聲道數(shù)模轉(zhuǎn)換器 |
| 文件頁(yè)數(shù)： | 6/21頁(yè) |
| 文件大?。?/td> | 226K |
| 代理商： | AK4380VT |
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ASAHI KASEI
[AK4380]
MS0018-E-01
2000/8
- 6 -
SWITCHING CHARACTERISTICS
(Ta = 25
°
C; VDD = 4.5
～
5.5V; C
L
= 20pF)
Parameter
Master Clock Frequency
Duty Cycle
LRCK Frequency
Duty Cycle
Audio Interface Timing
BICK Period
Normal Speed Mode
Double Speed Mode
BICK Pulse Width Low
Pulse Width High
BICK “
↑
” to LRCK Edge (Note 10)
LRCK Edge to BICK “
↑
” (Note 10)
SDTI Hold Time
SDTI Setup Time
Control Interface Timing
CCLK Period
CCLK Pulse Width Low
Pulse Width High
CDTI Setup Time
CDTI Hold Time
CSN High Time
CSN “
↓
” to CCLK “
↑
”
CCLK “
↑
” to CSN “
↑
”
Reset Timing
PDN Pulse Width (Note 11)
Symbol
fCLK
dCLK
fs
Duty
min
2.048
40
8
45
typ
max
36.864
60
96
55
Units
MHz
%
kHz
%
11.2896
44.1
tBCK
tBCK
tBCKL
tBCKH
tBLR
tLRB
tSDH
tSDS
1/128fs
1/64fs
70
70
40
40
40
40
ns
ns
ns
ns
ns
ns
ns
ns
tCCK
tCCKL
tCCKH
tCDS
tCDH
tCSW
tCSS
tCSH
200
80
80
40
40
150
50
50
ns
ns
ns
ns
ns
ns
ns
ns
tPD
150
ns
Notes: 10. BICK rising edge must not occur at the same time as LRCK edge.
11. The AK4380 can be reset by PDN= “L” upon power up.
If MCLK frequency or DFS changes, the AK4380 should be reset by PDN pin or RSTN bit.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AK4382A | 112dB 192kHz 24-Bit 2ch DAC |
| AK4382 | 112dB 192kHz 24-BIT SCH DAC |
| AK4382VT | 112dB 192kHz 24-BIT SCH DAC |
| AK4384ET | 106dB 192kHz 24-Bit 2ch ツヒ DAC |
| AK4384 | 106dB 192kHz 24-Bit 2ch DAC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AK4380VT-E2 | 制造商:Asahi Kasei Microsystems Co Ltd 功能描述:24BIT 96K 100DB |
| AK4381 | 制造商:AKM 制造商全稱:AKM 功能描述:108DB 192KHZ 24-BIT 2CH DAC |
| AK4381VT | 制造商:AKM 制造商全稱:AKM 功能描述:108DB 192KHZ 24-BIT 2CH DAC |
| AK4381VTP-E2 | 制造商:Asahi Kasei Microsystems Co Ltd 功能描述:5V 108DB DAC |
| AK4382 | 制造商:AKM 制造商全稱:AKM 功能描述:EVALUATION BOARD REV.A FOR AK4382 |
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