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參數資料
| 型號： | AK4126VQ |
| 廠商： | Asahi Kasei Microsystems Co.,Ltd |
| 英文描述： | 6ch 192kHz / 24-Bit Asynchronous SRC |
| 中文描述： | 6通道192kHz的/ 24位異步鋼骨混凝土 |
| 文件頁數： | 21/27頁 |
| 文件大小： | 241K |
| 代理商： | AK4126VQ |
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ASAHI KASEI
[AK4126]
MS0544-E-00
2006/09
- 21 -
PLL Loop Filter
The C1 and R should be connected in series and attached between FILT pin and AVSS in parallel with C2. (See Figure 15,
Table 8 and Table 9) Please be careful the noise onto the FILT pin. When using IBICK, the value of an external element
doesn't depend on the IBICK input frequency.
AK4126
FILT
C1
R
AVSS
C2
Figure 15. PLL Loop Filter
1. When using ILRCK
PLL2
PLL1
L
PLL0
L
ILRCK
8k
～
96kHz
8k
～
192kHz
16k
～
192kHz
8k
～
192kHz
16k
～
192kHz
Table 8. PLL Loop Filter (ILRCK Mode)
R [
]
1.8k
±
5%
1k
±
5%
1.5k
±
5%
1k
±
5%
1.5k
±
5%
C1 [
μ
F]
0.68
±
30%
1.0
±
30%
0.68
±
30%
1.0
±
30%
0.68
±
30%
C2 [nF]
0.68
±
30%
2.2
±
30%
0.68
±
30%
2.2
±
30%
0.68
±
30%
L
L
L
H
L
H
L
- Note. Smaller value can be selected for the capacitors (C1, C2) in case of ILRCK range from 16kHz to 192kHz.
- Note. Tolerance of R, C1, and C2 includes the temperature characteristics.
2. When using IBICK
PLL2
PLL1
PLL0
ILRCK
H
x
x
8k
～
192kHz
Table 9. PLL Loop Filter (IBICK Mode, “x”: Don’t care)
- Note. The IBCIK must be continuous except when the clocks are changed.
- Note. IBCIK = 32fsi is supported only 16bit LSB justified and I
2
S Compatible.
- Note. Tolerance of R, C1, and C2 includes the temperature characteristics.
R [
]
470
±
5%
C1 [
μ
F]
0.22
±
30%
C2 [nF]
1.0
±
30%
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