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參數(shù)資料
| 型號： | AK4115 |
| 廠商： | Asahi Kasei Microsystems Co.,Ltd |
| 英文描述： | High Feature 192kHz 24bit Digital Audio Interface Transceiver |
| 中文描述： | 高功能192kHz的24位數(shù)字音頻接口收發(fā)器 |
| 文件頁數(shù)： | 61/64頁 |
| 文件大小： | 606K |
| 代理商： | AK4115 |
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ASAHI KASEI
[AK4115]
MS0573-E-00
2006/12
- 61 -
SYSTEM DESIGN
Figure 53 shows the example of system connection diagram for 4-wire serial mode.
RX5
1
2
3
4
5
6
7
8
9
10
11
TEST(AVSS)
RX6
PDN
RX7
DVDD
VIN
DAUX
DVSS
MCKO1
MCKO2
Top View
R
64
63
62
A
R
61
60
58
57
59
55
54
56
53
A
R
A
R
A
R
R
A
P
12 OVDD
13 OVSS
14 BICK
15 SDTO
16 LRCK
52
A
51
V
50
R
49
A
B
17
C
18
U
19
V
20
T
21
T
22
T
23
T
24
T
25
X
26
X
27
X
28
X
29
O
30
O
31
E
32
44
43
42
41
40
39
38
37
36
35
34
33
IIC
BVSS
DVSS
DVDD
CSN
CCLK
CDTI
CDTO
INT1
INT0
ELRCK
EMCK
45
PSEL
46
XTL0
47
XTL1
48
FILT
100p
24k
uP
10k
4.7
μ
C1
10n
DSP2
DSP1
uP
S
S
S/PDIF Sources
S/PDIF out
5V
3.3V
3.3V
3.3V
C1
C1
C2
C2 C1
C1
C1
+
C2
C
C
C
C
C1
C2
C1
C2
+
+
+
+
+
C1: 0.1
μ
C2: 10
μ
3.3V
Figure 53. Typical Connection Diagram (4-wire serial mode)
Notes:
- For setting of XTL0 and XTL1, refer the Table 13.
- “C” depends on the crystal.
- AVSS, BVSS, TVSS, OVSS and DVSS must be connected the same ground plane.
- Digital signals, especially clocks, should be kept away from the R and FILT pins in order to avoid an effect to
the clock jitter performance.
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