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參數(shù)資料
| 型號： | AK2305 |
| 廠商： | Asahi Kasei Microsystems Co.,Ltd |
| 元件分類： | Codec |
| 英文描述： | Dual PCM CODEC for ISDN TERMINAL ADAPTER |
| 中文描述： | 雙PCM編解碼器的ISDN終端適配器 |
| 文件頁數(shù)： | 34/43頁 |
| 文件大?。?/td> | 481K |
| 代理商： | AK2305 |
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ASAHI K ASEI [AK 2305]
C0029-E-02 34 1999/8
Timing Specification
Unless otherwise noted, the specification applies for TA = -40 to +85
o
C, DVDD = AVDD = 5V±5%,DVSS = AVSS
= 0V and FS0,FS1 = 8kHz. All timing parameters are measured at VOH = 2.0V and VOL =0.7V.
Lomg Frame,Short Frame,GCI, IDL Timing
Parameter
Symbol
Min
Typ
Max
Unit Ref fig
FS Frequency
1/t
PF
-
8
-
kHz
BCLK Frequency
1/t
PB
64
4096
kHz
BCLK Pulse Width High
t
WBH
80
ns
BCLK Pulse Width Low
t
WBL
80
ns
Rising Time: (BCLK,FS0,FS1,DX0,DX1,DR0,DR1)
t
R
40
ns
Falling Time: (BCLK,FS0,FS1,DX0,DX1,DR0,DR1)
t
F
40
ns
Hold Time: BCLK Low to FS High
t
HBF
40
ns
Setup Time: FS High to BCLK Low
t
SFB
70
ns
Setup Time: DR to BCLK Low
t
SDB
40
ns
Hold Time: BCLK Low to DR
t
HBD
40
ns
Delay Time: BCLK High to DX valid (Note1)
t
DBD
60
ns
Fig.2
Fig.3
Fig.4
Fig.5
Long Frame
Hold Time: 2
nd
period of BCLK Low to FS Low
Delay Time: FS or BCLK High, whichever is later,to DX valid
t
HBFL
40
ns
(Note1)
t
DZFL
60
ns
Delay Time: FS or BCLK Low, whichever is later, to DX High-
Z (Note1)
FS Pulse Width Low
t
DZCL
10
60
ns
t
WFSL
1
BCLK
Fig.2
Short Frame
Hold Time: BCLK Low to FS Low
t
HBFS
40
ns
Setup Time: FS Low to BCLK Low
t
SFBS
40
ns
Delay Time: BCLK Low to DX High-Z (Note1)
t
DZCS
10
60
ns
Fig.3
GCI
BCLK Frequency
1/t
PB
512
4096
kHz
Delax Time: Second BCLK Low to DX High-Z
t
DZCG
10
60
ns
Setup Time: DR to Second BCLK High
t
SDBG
40
ns
Hold Time: Second BCLK High to DR
t
HBDG
40
ns
Fig.4
IDL
BCLK Frequency
1/t
PB
256
4096
kHz
Fig.5
Note1) When with 150pF cap, and two LSTTL operating.
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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