參數(shù)資料
型號(hào)： ADV7196A
廠商： Analog Devices, Inc.
英文描述： Multiformat Progressive Scan/HDTV Encoder with Three 11-Bit DACs, 10-Bit Data Input, and Macrovision
中文描述： 多格式逐行掃描/高清晰度電視編碼器三種11位DAC，10位數(shù)據(jù)輸入，以及Macrovision
文件頁(yè)數(shù)： 3/36頁(yè)
文件大?。?/td> 501K
代理商： ADV7196A
REV. 0
ADV7196A
–3–
ADAPTIVE FILTER GAIN 3 . . . . . . . . . . . . . . . . . . . . . . 23
AFG3 (AFG3)7–0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
ADAPTIVE FILTER THRESHOLD A . . . . . . . . . . . . . . . 23
AFTA (AFTA)7–0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
ADAPTIVE FILTER THRESHOLD B . . . . . . . . . . . . . . . 23
AFTB (AFTB)7–0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
ADAPTIVE FILTER THRESHOLD C . . . . . . . . . . . . . . . 23
AFTC (AFTC)7–0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
SHARPNESS FILTER AND ADAPTIVE FILTER
APPLICATION EXAMPLES . . . . . . . . . . . . . . . . . . . . . 24
Sharpness Filter Application . . . . . . . . . . . . . . . . . . . . . . 24
Adaptive Filter Control Application . . . . . . . . . . . . . . . . . 25
HDTV MODE . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
MODE REGISTER 0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
MR0 (MR07–MR00) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
HEXMR0 BIT DESCRIPTION . . . . . . . . . . . . . . . . . . . . . 26
Output Standard Selection (MR00–MR01) . . . . . . . . . . . 26
Input Control Signals (MR02–MR03) . . . . . . . . . . . . . . . 26
Reserved (MR04) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
Input Standard (MR05) . . . . . . . . . . . . . . . . . . . . . . . . . . 26
DV Polarity (MR06) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
Reserved (MR07) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
MODE REGISTER 1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
MR1 (MR17–MR10) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
MR1 BIT DESCRIPTION . . . . . . . . . . . . . . . . . . . . . . . . . 27
Pixel Data Enable (MR10) . . . . . . . . . . . . . . . . . . . . . . . . 27
Input Format (MR11) . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
Test Pattern Enable (MR12) . . . . . . . . . . . . . . . . . . . . . . 27
Test Pattern Hatch/Frame (MR13) . . . . . . . . . . . . . . . . . 27
VBI Open (MR14) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
Reserved (MR15–MR17) . . . . . . . . . . . . . . . . . . . . . . . . . 27
MODE REGISTER 2 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28
MR1 (MR27–MR20) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28
MR2 BIT DESCRIPTION . . . . . . . . . . . . . . . . . . . . . . . . . 28
Y Delay (MR20–MR22) . . . . . . . . . . . . . . . . . . . . . . . . . 28
Color Delay (MR23–MR25) . . . . . . . . . . . . . . . . . . . . . . 28
Reserved (MR26–MR27) . . . . . . . . . . . . . . . . . . . . . . . . . 28
MODE REGISTER 3 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28
MR3 (MR37–MR30) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28
MR3 BIT DESCRIPTION . . . . . . . . . . . . . . . . . . . . . . . . . 28
HDTV Enable (MR30) . . . . . . . . . . . . . . . . . . . . . . . . . . 28
Reserved (MR31–MR32) . . . . . . . . . . . . . . . . . . . . . . . . . 28
DAC A Control (MR33) . . . . . . . . . . . . . . . . . . . . . . . . . 28
DAC B Control (MR34) . . . . . . . . . . . . . . . . . . . . . . . . . 28
DAC C Control (MR35) . . . . . . . . . . . . . . . . . . . . . . . . . 28
Reserved (MR36–MR37) . . . . . . . . . . . . . . . . . . . . . . . . . 28
MODE REGISTER 4 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29
MR4 (MR47–MR40) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29
MR4 BIT DESCRIPTION . . . . . . . . . . . . . . . . . . . . . . . . . 29
Timing Reset (MR40) . . . . . . . . . . . . . . . . . . . . . . . . . . . 29
MODE REGISTER 5 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29
MR5 (MR57–MR50) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29
MR5 BIT DESCRIPTION . . . . . . . . . . . . . . . . . . . . . . . . . 29
Reserved (MR50) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29
RGB Mode (MR51) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29
Sync on PrPb (MR52) . . . . . . . . . . . . . . . . . . . . . . . . . . . 29
Color Output Swap (MR53) . . . . . . . . . . . . . . . . . . . . . . 29
Reserved (MR54–MR57) . . . . . . . . . . . . . . . . . . . . . . . . . 29
DAC TERMINATION AND LAYOUT
CONSIDERATIONS . . . . . . . . . . . . . . . . . . . . . . . . . . . 30
Voltage Reference . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30
PC BOARD LAYOUT CONSIDERATIONS . . . . . . . . . . 30
Supply Decoupling . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31
Digital Signal Interconnect . . . . . . . . . . . . . . . . . . . . . . . . 31
Analog Signal Interconnect . . . . . . . . . . . . . . . . . . . . . . . 31
Video Output Buffer and Optional Output Filter . . . . . . . 31
OUTLINE DIMENSIONS . . . . . . . . . . . . . . . . . . . . . . . . . 36
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