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參數(shù)資料
| 型號： | ADV7177KSZ-REEL |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 14/44頁 |
| 文件大小： | 0K |
| 描述： | IC DAC VIDEO NTSC 3-CH 44MQFP |
| 產品變化通告： | ADV7xxx Obsolescence 16/Jan/2012 |
| 標準包裝： | 800 |
| 類型： | 視頻編碼器 |
| 應用： | 機頂盒，電視 |
| 電壓 - 電源，模擬： | 3 V ~ 3.6 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 44-QFP |
| 供應商設備封裝： | 44-MQFP（10x10） |
| 包裝： | 帶卷 (TR) |
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ADV7177/ADV7178
Rev. C | Page 21 of 44
Mode 1: Master Option HSYNC, BLANK, FIELD
Timing Register 0 TR0 = X X X X X 0 1 1
In this mode, the ADV7177/ADV7178 can generate horizontal SYNC and odd/even FIELD signals. A transition of the FIELD input when
HSYNC is low indicates a new frame, that is, vertical retrace. The BLANK signal is optional. When the BLANK input is disabled, the
ADV7177/ADV7178 automatically blank all normally blank lines. Pixel data is latched on the rising clock edge following the timing
signal transitions. Mode 1 is illustrated in Figure 18 (NTSC) and Figure 19 (PAL). Figure 20 illustrates the HSYNC, BLANK, and FIELD
for an odd or even field transition relative to the pixel data.
FIELD
PIXEL
DATA
PAL = 12
× CLOCK/2
NTSC = 16
× CLOCK/2
PAL = 132
× CLOCK/2
NTSC = 122
× CLOCK/2
Cb
Y
Cr
Y
HSYNC
BLANK
00228-020
Figure 20. Timing Mode 1 Odd/Even Field Transitions Master/Slave
相關PDF資料 |
PDF描述 |
|---|---|
| ADV7179KCPZ-REEL | IC ENCODER VID NTSC/PAL 40LFCSP |
| ADV7181CBSTZ | IC VIDEO DECODER SDTV RGB 64LQFP |
| ADV7181DWBCPZ-RL | IC VIDEO DECODER SD/HD 64LFCSP |
| ADV7183BBSTZ | IC VIDEO DECODER NTSC 80-LQFP |
| ADV7184BSTZ | IC DECODER VID SDTV MULTI 80LQFP |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| ADV7178 | 制造商:AD 制造商全稱:Analog Devices 功能描述:Integrated Digital CCIR-601 to PAL/NTSC Video Encoder |
| ADV7178KS | 制造商:Analog Devices 功能描述: |
| ADV7178KS-REEL | 制造商:Analog Devices 功能描述: |
| ADV7179 | 制造商:AD 制造商全稱:Analog Devices 功能描述:Chip Scale PAL/NTSC Video Encoder with Advanced Power Management |
| ADV7179BCP | 制造商:Analog Devices 功能描述:Video Encoder 3DAC 10-Bit 40-Pin LFCSP EP 制造商:Analog Devices 功能描述:IC VIDEO ENCODER |
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