參數(shù)資料
型號(hào)： ADSP-21990BSTZ
廠商： Analog Devices Inc
文件頁數(shù)： 32/50頁
文件大?。?/td> 0K
描述： IC DSP CONTROLLER 16BIT 176-LQFP
產(chǎn)品變化通告： Product Discontinuance 27/Oct/2011
標(biāo)準(zhǔn)包裝： 1
系列： ADSP-21xx
類型： 定點(diǎn)
接口： SPI，SSP
時(shí)鐘速率： 160MHz
非易失內(nèi)存： 外部
芯片上RAM： 20kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 2.50V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 176-LQFP
供應(yīng)商設(shè)備封裝： 176-LQFP（24x24）
包裝： 托盤
Rev. A
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August 2007
ADSP-21990
Serial Peripheral Interface Port—Slave Timing
Table 14 and Figure 17 describe SPI port slave operations.
Table 14. Serial Peripheral Interface (SPI) Port—Slave Timing
Parameter
Min
Max
Unit
Timing Requirements
tSPICHS
Serial Clock High Period
2tHCLK
ns
tSPICLS
Serial Clock Low Period
2tHCLK
ns
tSPICLK
Serial Clock Period
4tHCLK
ns
tHDS
Last SPICLK Edge to SPISS Not Asserted
2tHCLK
ns
tSPITDS
Sequential Transfer Delay
2tHCLK + 4
ns
tSDSCI
SPISS Assertion to First SPICLK Edge
2tHCLK
ns
tSSPID
Data Input Valid to SCLK Edge (Data Input Setup)
1.6
ns
tHSPID
SCLK Sampling Edge to Data Input Invalid (Data In Hold)
2.4
ns
Switching Characteristics
tDSOE
SPISS Assertion to Data Out Active
0
8
ns
tDSDHI
SPISS Deassertion to Data High Impedance
0
10
ns
tDDSPID
SCLK Edge to Data Out Valid (Data Out Delay)
0
10
ns
tHDSPID
SCLK Edge to Data Out Invalid (Data Out Hold)
0
10
ns
Figure 17. Serial Peripheral Interface (SPI) Port—Slave Timing
tHSPID
tDDSPID
tDSDHI
LSB
MSB
VALID
tHSPID
tDSOE
tHDSPID
MISO
(OUTPUT)
MOSI
(INPUT)
SPISS
(INPUT)
SCLK
(CPOL = 0)
(INPUT)
SCLK
(CPOL = 1)
(INPUT)
tSPICHS
tSPICLS
tSPICLK
tHDS
tSPICHS
tSSPID
tHSPID
tDSDHI
LSB
VALID
MSB
VALID
tDSOE
tDDSPID
MISO
(OUTPUT)
MOSI
(INPUT)
LSB
VALID
LSB
tSPITDS
tDDSPID
CPHA = 0
CPHA = 1
tSDSCI
tSSPID
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PDF描述
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