Timing Requirements: t
參數(shù)資料
型號： ADSP-2186BSTZ-160
廠商： Analog Devices Inc
文件頁數(shù)： 18/36頁
文件大?。?/td> 0K
描述： IC DSP CONTROLLER 16BIT 100LQFP
標準包裝： 1
系列： ADSP-21xx
類型： 定點
接口： 主機接口，串行端口
時鐘速率： 40MHz
非易失內存： 外部
芯片上RAM： 40kB
電壓 - 輸入/輸出： 5.00V
電壓 - 核心： 5.00V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 100-LQFP
供應商設備封裝： 100-LQFP（14x14）
包裝： 托盤
ADSP-2186
–25–
REV. B
TIMING PARAMETERS
Parameter
Min
Max
Unit
IDMA Read, Long Read Cycle
Timing Requirements:
tIKR
IACK Low before Start of Read1
0ns
tIRK
End Read after
IACK Low2
2ns
Switching Characteristics:
tIKHR
IACK High after Start of Read1
15
ns
tIKDS
IAD15–0 Data Setup before
IACK Low
0.5 tCK – 10
ns
tIKDH
IAD15–0 Data Hold after End of Read2
0ns
tIKDD
IAD15–0 Data Disabled after End of Read2
10
ns
tIRDE
IAD15–0 Previous Data Enabled after Start of Read
0
ns
tIRDV
IAD15–0 Previous Data Valid after Start of Read
15
ns
tIRDH1
IAD15–0 Previous Data Hold after Start of Read (DM/PM1)3
2 tCK – 5
ns
tIRDH2
IAD15–0 Previous Data Hold after Start of Read (PM2)4
tCK – 5
ns
NOTES
1Start of Read =
IS Low and IRD Low.
2End of Read =
IS High or IRD High.
3DM read or first half of PM read.
4Second half of PM read.
tIKR
PREVIOUS
DATA
READ
DATA
tIKHR
tIKDS
tIRDV
tIRDH
tIKDD
tIRDE
tIKDH
IAD15–0
IACK
IS
IRD
tIRK
Figure 20. IDMA Read, Long Read Cycle
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