Timing Requirements: tIKW
參數(shù)資料
型號： ADSP-2184BSTZ-160
廠商： Analog Devices Inc
文件頁數(shù)： 16/31頁
文件大?。?/td> 0K
描述： IC DSP CONTROLLER 16BIT 100LQFP
標準包裝： 1
系列： ADSP-21xx
類型： 定點
接口： 主機接口，串行端口
時鐘速率： 40MHz
非易失內(nèi)存： 外部
芯片上RAM： 20kB
電壓 - 輸入/輸出： 5.00V
電壓 - 核心： 5.00V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 100-LQFP
供應(yīng)商設(shè)備封裝： 100-LQFP（14x14）
包裝： 托盤
產(chǎn)品目錄頁面： 738 (CN2011-ZH PDF)
ADSP-2184
–23–
REV. 0
Parameter
Min
Max
Unit
IDMA Write, Long Write Cycle
Timing Requirements:
tIKW
IACK Low before Start of Write1
0ns
tIKSU
IAD15–0 Data Setup before
IACK Low2, 3, 4
0.5 tCK + 10
ns
tIKH
IAD15–0 Data Hold after
IACK Low2, 3, 4
2ns
Switching Characteristics:
tIKLW
Start of Write to
IACK Low4
1.5 tCK
ns
tIKHW
Start of Write to
IACK High
15
ns
NOTES
1Start of Write =
IS Low and IWR Low.
2If Write Pulse ends before
IACK Low, use specifications t
IDSU, t IDH.
3If Write Pulse ends after
IACK Low, use specifications t
IKSU, tIKH.
4This is the earliest time for
IACK Low from Start of Write. For IDMA Write cycle relationships, please refer to the ADSP-2100 Family User’s Manual, Third Edition.
IAD 15–0
DATA
tIKHW
tIKW
IACK
IS
IWR
tIKLW
tIKH
tIKSU
Figure 17. IDMA Write, Long Write Cycle
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