參數(shù)資料
型號： ADSP-21161N
廠商： Analog Devices, Inc.
元件分類： 數(shù)字信號處理
英文描述： DSP Microcomputer
中文描述： DSP微機(jī)
文件頁數(shù)： 50/60頁
文件大?。?/td> 1019K
代理商： ADSP-21161N
ADSP-21161N
–50–
REV. A
JTAG Test Access Port and Emulation
Table 37. JTAG Test Access Port and Emulation
Parameter
Timing Requirements
t
TCK
t
STAP
t
HTAP
t
SSYS
t
HSYS
t
TRSTW
Min
Max
Unit
TCK Period
TDI, TMS Setup Before TCK High
TDI, TMS Hold After TCK High
System Inputs Setup Before TCK Low
1
System Inputs Hold After TCK Low
1
TRST
Pulsewidth
t
CK
5
6
2
15
4t
CK
ns
ns
ns
ns
ns
ns
Switching Characteristics
t
DTDO
t
DSYS
TDO Delay from TCK Low
System Outputs Delay After TCK Low
2
13
30
ns
ns
1
System Inputs = DATA47–16, ADDR23–0,
RD
,
WR
, ACK, RPBA,
SPIDS
, EBOOT, LBOOT,
DMAR2–1
, CLK_CFG1–0,
CLKDBL
,
CS
,
HBR
,
SBTS
, ID2–0,
IRQ2–0
,
RESET
,
BMS
, MISO, MOSI, SPICLK, DxA, DxB, SCLKx, FSx, LxDAT7–0, LxCLK, LxACK,
SDWE
,
HBG
,
RAS
,
CAS
,
SDCLK0, SDCKE, BRST,
BR6–1
,
PA
,
MS3–0
, FLAG11–0.
2
System Outputs =
BMS
, MISO, MOSI, SPICLK, DxA, DxB, SCLKx, FSx, LxDAT7–0, LxCLK, LxACK, DATA47–16,
SDWE
, ACK,
HBG
,
RAS
,
CAS
, SDCLK1–0, SDCKE, BRST,
RD
,
WR
,
BR6–1
,
PA
,
MS3–0
, ADDR23–0, FLAG11–0,
DMAG2–1
, DQM, REDY, CLKOUT, SDA10,
TIMEXP,
EMU
, BMSTR,
RSTOUT
.
Figure 36. JTAG Test Access Port and Emulation
TCK
TMS
TDI
TDO
SYSTEM
INPUTS
SYSTEM
OUTPUTS
t
STAP
t
TCK
t
HTAP
t
DTDO
t
SSYS
t
HSYS
t
DSYS
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PDF描述
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