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參數(shù)資料
| 型號： | ADP5042ACPZ-2-R7 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 5/32頁 |
| 文件大?。?/td> | 1378K |
| 描述： | IC REG TRPL BCK/LINEAR 20LFCSP |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 拓?fù)洌?/td> | 降壓（降壓）同步（1），線性（LDO）（2） |
| 功能： | 任何功能 |
| 輸出數(shù)： | 3 |
| 頻率 - 開關(guān)： | 3MHz |
| 電壓/電流 - 輸出 1： | 1.5V，800mA |
| 電壓/電流 - 輸出 2： | 1.8V，300mA |
| 電壓/電流 - 輸出 3： | 3.3V，300mA |
| 帶 LED 驅(qū)動器： | 無 |
| 帶監(jiān)控器： | 是 |
| 帶序列發(fā)生器： | 是 |
| 電源電壓： | 1.7 V ~ 5.5 V |
| 工作溫度： | -40°C ~ 125°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-WFQFN 裸露焊盤，CSP |
| 供應(yīng)商設(shè)備封裝： | 20-LFCSP-WQ（4x4） |
| 包裝： | 標(biāo)準(zhǔn)包裝 |
| 其它名稱： | ADP5042ACPZ-2-R7DKR |
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Data Sheet
ADP5042
Rev. A | Page 5 of 32
BUCK SPECIFICATIONS
AVIN, VIN1 = 3.6 V, V
OUT1
= 1.8 V, T
J
= 40癈 to +125癈 for minimum/maximum specifications, L = 1 礖, C
OUT
= 10 礔, and T
A
= 25癈
for typical specifications, unless otherwise noted.
1
Table 3.
Parameter
Test Conditions/Comments
Min
Typ
Max
Unit
INPUT CHARACTERISTICS
Input Voltage Range (VIN1)
2.3
5.5
V
OUTPUT CHARACTERISTICS
Output Voltage Accuracy
PWM mode, T
A
= 25 癈 , I
LOAD
= 100 mA
1
+1
%
PWM mode
2
+2
%
VIN1 = 2.3 V to 5.5 V, PWM mode,
ILOAD = 1 to 800 mA
3
+3
%
PWM TO POWER SAVE MODE CURRENT THRESHOLD
100
mA
INPUT CURRENT CHARACTERISTICS
DC Operating Current
I
LOAD
= 0 mA, device not switching
21
35
糀
Shutdown Current
ENx = 0 V, T
A
= T
J
= 40癈 to +125癈
0.2
1.0
糀
SW CHARACTERISTICS
SW On Resistance
PFET
180
240
m?
PFET, AVIN = VIN1 = 5 V
140
190
m?
NFET
170
235
m?
NFET, AVIN = VIN1 = 5 V
150
210
m?
Current Limit
PFET switch peak current limit
1100
1360
1600
mA
ACTIVE PULL-DOWN
EN1 = 0 V
75
?
OSCILLATOR FREQUENCY
2.5
3.0
3.5
MHz
START-UP TIME
250
約
1
All limits at temperature extremes are guaranteed via correlation using standard statistical quality control (SQC).
LDO1, LDO2 SPECIFICATIONS
AVIN = 3.6 V, V
IN2,
IN3
= (V
OUT3
+ 0.2 V) or 2.3 V, whichever is greater; AVIN, VIN1 e VIN2, VIN3; I
OUT
= 10 mA; C
IN
= C
OUT
= 1 礔;
T
A
= 25癈, unless otherwise noted.
Table 4.
Parameter
Symbol
Conditions
Min
Typ
Max
Unit
INPUT VOLTAGE RANGE
V
IN2
, V
IN3
T
J
= 40癈 to +125癈
1.7
5.5
V
OPERATING SUPPLY CURRENT (per
LDO)
I
GND
I
OUT
= 0 礎(chǔ), V
OUT
= 3.3 V
15
礎(chǔ)
I
OUT
= 0 礎(chǔ), V
OUT
= 3.3 V, T
J
= 40癈 to +125癈
50
礎(chǔ)
IOUT = 10 mA
67
礎(chǔ)
IOUT = 10 mA, TJ = 40癈 to +125癈
105
礎(chǔ)
IOUT = 200 mA
100
礎(chǔ)
I
OUT
= 200 mA, T
J
= 40癈 to +125癈
245
礎(chǔ)
FIXED OUTPUT VOLTAGE ACCURACY
VOUT2, VOUT3
IOUT = 10 mA
1
+1
%
100 礎(chǔ) < IOUT < 300 mA
2
+2
%
V
IN2
,
V
IN3
= (V
OUT2
,
V
OUT3
+ 0.5 V) to 5.5 V
100 礎(chǔ) < I
OUT
< 300 mA
3
+3
%
VIN2, VIN3 = (VOUT2, VOUT3 + 0.5 V) to 5.5 V
TJ = 40癈 to +125癈
REGULATION
Line Regulation
VOUT2/VIN2
VOUT3/VIN3
VIN2, VIN3 = (VOUT2, VOUT3 + 0.5 V) to 5.5 V
0.03
+0.03
%/V
IOUT3 = 1 mA
T
J
= 40癈 to +125癈
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| ADP50450003CBZR | 制造商:Analog Devices 功能描述: |
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