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參數(shù)資料
| 型號： | ADDI7100BCPZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 16/20頁 |
| 文件大小： | 0K |
| 描述： | IC PROCESSOR CCD SIGNAL7 32LFCSP |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 類型： | CCD 信號處理器，12 位 |
| 應(yīng)用： | 數(shù)碼相機(jī) |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-VFQFN 裸露焊盤，CSP |
| 供應(yīng)商設(shè)備封裝： | 32-LFCSP-VQ（5x5） |
| 包裝： | 托盤 |
ADDI7100
Rev. C | Page 5 of 20
TIMING SPECIFICATIONS
Table 4.
Parameter
Symbol
Min
Typ
Max
Unit
SAMPLE CLOCKS
DATACLK, SHP, SHD Clock Period
tCONV
22
ns
DATACLK High/Low Pulse Width
tADC
9
11
ns
SHP Pulse Width
tSHP
5.5
ns
SHD Pulse Width
tSHD
5.5
ns
CLPOB Pulse Width1
2
20
Pixels
SHP Rising Edge to SHD Falling Edge
tS3
5.5
ns
SHP Rising Edge to SHD Rising Edge
tS1
9
11
tCONV tS2
ns
SHD Rising Edge to SHP Rising Edge
tS2
9
11
tCONV tS1
ns
SHD Rising Edge to SHP Falling Edge
tS4
5.5
ns
Internal Clock Delay
tID
4
ns
DATA OUTPUTS
Output Delay
tOD
15
ns
Pipeline Delay
15
Cycles
SERIAL INTERFACE
Maximum SCK Frequency (Must Not Exceed Pixel Rate)
fSCLK
40
MHz
SL to SCK Setup Time
tLS
10
ns
SCK to SL Hold Time
tLH
10
ns
SDATA Valid to SCK Rising Edge Setup
tDS
10
ns
SCK Rising Edge to SDATA Valid Hold
tDH
10
ns
1 Minimum CLPOB pulse width is for functional operation only. Wider typical pulses are recommended to achieve low noise clamp performance.
Timing Diagrams
PIXEL N
PIXEL
N + 1
PIXEL
N + 2
PIXEL
N + 14
PIXEL
N + 15
tOD
tS3
tS4
tID
N – 15
N – 14
N – 13
N – 1
N
NOTES
1. RECOMMENDED PLACEMENT FOR DATACLK RISING (ACTIVE) EDGE IS NEAR THE SHP OR SHD RISING
(ACTIVE) EDGE. THE BEST LOCATION FOR LOWEST NOISE WILL BE SYSTEM DEPENDENT.
2. CCD SIGNAL IS SAMPLED AT SHP AND SHD RISING EDGES.
SHP
SHD
DATACLK
OUTPUT
DATA
CCD
SIGNAL
(CCDIN)
tS1
tCONV
tS2
07
60
8-
0
12
Figure 3. CCD Sampling Timing (Default Polarity Settings)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MAX3243CUI+ | IC TXRX RS-232 W/SHTDWN 28TSSOP |
| ICS1893BKILFT | PHYCEIVER LOW PWR 3.3V 56-VQFN |
| ADV7180BST48Z | IC VID DECOD SDTV 10BIT 48LQFP |
| AD9889BBBCZ-80 | TRANSMITTER HDMI/DVI 76-CSPBGA |
| AD8325ARUZ | IC LN DVR CATV FINE-STEP 28TSSOP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| ADDI7100BCPZRL | 功能描述:IC PROCESSOR CCD SIGNAL7 32LFCSP RoHS:是 類別:集成電路 (IC) >> 線性 - 視頻處理 系列:- 產(chǎn)品變化通告:Product Discontinuation 07/Mar/2011 標(biāo)準(zhǔn)包裝:3,000 系列:OMNITUNE™ 類型:調(diào)諧器 應(yīng)用:移動電話，手機(jī)，視頻顯示器 安裝類型:表面貼裝 封裝/外殼:65-WFBGA 供應(yīng)商設(shè)備封裝:PG-WFSGA-65 包裝:帶卷 (TR) 其它名稱:SP000365064 |
| ADDI9000BBCZRL | 制造商:Analog Devices 功能描述: |
| ADDI9000BCBZRL | 制造商:Analog Devices 功能描述:DRIVER |
| ADDI9000XCBZ | |
| ADDI9001BBCZ | 制造商:Analog Devices 功能描述: |
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