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參數(shù)資料
| 型號： | ADCLK854BCPZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 15/16頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLOCK BUFFER MUX 2:12 48LFCSP |
| 設(shè)計資源： | Clock Distribution Circuit with Pin-Programmable Output Frequency, Output Logic Levels, and Fanout (CN0152) |
| 標準包裝： | 1 |
| 類型： | 扇出緩沖器（分配），多路復(fù)用器 |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:12 |
| 差分 - 輸入:輸出： | 是/是 |
| 輸入： | CML，CMOS，HSTL，LVDS，LVPECL |
| 輸出： | CMOS，LVDS |
| 頻率 - 最大： | 1.2GHz |
| 電源電壓： | 1.71 V ~ 1.89 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 48-VFQFN 裸露焊盤，CSP |
| 供應(yīng)商設(shè)備封裝： | 48-LFCSP |
| 包裝： | 托盤 |
ADCLK854
Rev. 0 | Page 8 of 16
Pin No.
Mnemonic
Description
26
OUT7 (OUT7A)
True Side of Differential LVDS Output 7, or CMOS Output 7 on Channel A.
27
OUT6 (OUT6B)
Complementary Side of Differential LVDS Output 6, or CMOS Output 6 on Channel B.
28
OUT6 (OUT6A)
True Side of Differential LVDS Output 6, or CMOS Output 6 on Channel A.
31
OUT5 (OUT5B)
Complementary Side of Differential LVDS Output 5, or CMOS Output 5 on Channel B.
32
OUT5 (OUT5A)
True Side of Differential LVDS Output 5, or CMOS Output 5 on Channel A.
33
OUT4 (OUT4B)
Complementary Side of Differential LVDS Output 4, or CMOS Output 4 on Channel B.
34
OUT4 (OUT4A)
True Side of Differential LVDS Output 4, or CMOS Output 4 on Channel A.
35
NC
No Connect.
36
NC
No Connect.
39
OUT3 (OUT3B)
Complementary Side of Differential LVDS Output 3, or CMOS Output 3 on Channel B.
40
OUT3 (OUT3A)
True Side of Differential LVDS Output 3, or CMOS Output 3 on Channel A.
41
OUT2 (OUT2B)
Complementary Side of Differential LVDS Output 2, or CMOS Output 2 on Channel B.
42
OUT2 (OUT2A)
True Side of Differential LVDS Output 2, or CMOS Output 2 on Channel A.
45
OUT1 (OUT1B)
Complementary Side of Differential LVDS Output 1, or CMOS Output 1 on Channel B.
46
OUT1 (OUT1A)
True Side of Differential LVDS Output 1, or CMOS Output 1 on Channel A.
47
OUT0 (OUT0B)
Complementary Side of Differential LVDS Output 0, or CMOS Output 0 on Channel B.
48
OUT0 (OUT0A)
True Side of Differential LVDS Output 0, or CMOS Output 0 on Channel A.
(49)
EPAD
Exposed Paddle. The exposed paddle must be connected to GND.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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