參數(shù)資料
型號(hào)： ADCLK854/PCBZ
廠(chǎng)商： Analog Devices Inc
文件頁(yè)數(shù)： 14/16頁(yè)
文件大?。?/td> 0K
描述： BOARD EVALUATION FOR ADCLK845
設(shè)計(jì)資源： Clock Distribution Circuit with Pin-Programmable Output Frequency, Output Logic Levels, and Fanout (CN0152)
標(biāo)準(zhǔn)包裝： 1
主要目的： 計(jì)時(shí)，時(shí)鐘緩沖器 / 驅(qū)動(dòng)器 / 接收器 / 變換器
嵌入式： 否
已用 IC / 零件： ADCLK854
主要屬性： 2 輸入，12 輸出
次要屬性： CMOS，LVDS 輸出
已供物品： 板
ADCLK854
Rev. 0 | Page 7 of 16
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS
13
14
15
16
17
18
19
20
21
22
23
24
CT
R
L
_C
SL
EEP
O
U
T
10
(
O
UT
10B)
O
U
T
10
(
O
UT
10A)
GN
D
V
S
OU
T
9(
OU
T
9B
)
OU
T
9(
OU
T
9A
)
OU
T
8(
OU
T
8B
)
OU
T
8(
OU
T
8A
)
GN
D
V
S
48
47
46
45
44
43
42
41
40
39
38
37
OU
T
0(
OU
T
0A
)
OU
T
0(
OU
T
0B
)
OU
T
1(
OU
T
1A
)
OU
T
1(
OU
T
1B
)
GN
D
V
S
OU
T
2(
OU
T
2A
)
OU
T
2(
OU
T
2B
)
OU
T
3(
OU
T
3A
)
OU
T
3(
OU
T
3B
)
GN
D
V
S
1
2
3
4
5
6
7
8
9
10
11
12
VREF
CLK0
GND
CLK1
VS
OUT11 (OUT11B)
OUT11 (OUT11A)
IN_SEL
CTRL_A
CTRL_B
NC
OUT4 (OUT4A)
OUT4 (OUT4B)
OUT5 (OUT5A)
OUT5 (OUT5B)
VS
GND
OUT6 (OUT6A)
OUT6 (OUT6B)
OUT7 (OUT7A)
OUT7 (OUT7B)
35
NC
36
34
33
32
31
30
29
28
27
26
25
ADCLK854
TOP VIEW
(Not to Scale)
PIN 1
INDICATOR
NOTES:
1. NC = NO CONNECT.
2. EXPOSED PADDLE MUST BE CONNECTED TO GND.
07
21
8-
0
02
Figure 2. Pin Configuration
Table 7. Pin Function Descriptions
Pin No.
Mnemonic
Description
1
VREF
Reference Voltage.
2
CLK0
Input (Negative) 0.
3
CLK0
Input (Positive) 0.
7, 18, 24, 30,
37, 43
VS
Supply Voltage.
5
CLK1
Input (Negative) 1.
6
CLK1
Input (Positive) 1.
8
OUT11 (OUT11B)
Complementary Side of Differential LVDS Output 11, or CMOS Output 11 on Channel B.
9
OUT11 (OUT11A)
True Side of Differential LVDS Output 11, or CMOS Output 11 on Channel A.
10
IN_SEL
Input Select. (0 = CLK0, CLK0; 1 = CLK1, CLK1). CMOS logic input with 200 kΩ pull-down resistor.
11
CTRL_A
Control for Output 3 to Output 0 (0 = LVDS, 1 = CMOS). CMOS logic input with 200 kΩ pull-down resistor.
12
CTRL_B
Control for Output 7 to Output 4 (0 = LVDS, 1 = CMOS). CMOS logic input with 200 kΩ pull-down resistor.
13
CTRL_C
Control for Output 11 to Output 8 (0 = LVDS, 1 = CMOS). CMOS logic input with 200 kΩ pull-down resistor.
14
SLEEP
Sleep Mode Control (0 = normal operation, 1 = sleep). CMOS logic input with 200 kΩ pull down resistor.
15
OUT10 (OUT10B)
Complementary Side of Differential LVDS Output 10, or CMOS Output 10 on Channel B.
16
OUT10 (OUT10A)
True Side of Differential LVDS Output 10, or CMOS Output 10 on Channel A.
4, 17, 23, 29,
38, 44
GND
Ground Pin.
19
OUT9 (OUT9B)
Complementary Side of Differential LVDS Output 9, or CMOS Output 9 on Channel B.
20
OUT9 (OUT9A)
True Side of Differential LVDS Output 9, or CMOS Output 9 on Channel A.
21
OUT8 (OUT8B)
Complementary Side of Differential LVDS Output 8, or CMOS Output 8 on Channel B.
22
OUT8 (OUT8A)
True Side of Differential LVDS Output 8, or CMOS Output 8 on Channel A.
25
OUT7 (OUT7B)
Complementary Side of Differential LVDS Output 7, or CMOS Output 7 on Channel B.
相關(guān)PDF資料
PDF描述
ECM31DCSH-S288 CONN EDGECARD 62POS .156 EXTEND
RNF-100-MINI-SPL-3/8-BK HEATSHRINK RNF-100 3/8"X35' BLK
MLF2012DR39M INDUCTOR MULTILAYER .39UH 0805
ADCLK948/PCBZ BOARD EVALUATION FOR ADCLK948
MLF2012DR33M INDUCTOR MULTILAYER .33UH 0805
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參數(shù)描述
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ADCLK905BCPZ-R7 功能描述:IC CLK/DATA BUFF DVR 1:1 16LFCSP RoHS:是 類(lèi)別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘緩沖器，驅(qū)動(dòng)器 系列:SIGe 產(chǎn)品培訓(xùn)模塊:High Bandwidth Product Overview 標(biāo)準(zhǔn)包裝:1,000 系列:Precision Edge® 類(lèi)型:扇出緩沖器（分配） 電路數(shù):1 比率 - 輸入:輸出:1:4 差分 - 輸入:輸出:是/是 輸入:CML，LVDS，LVPECL 輸出:CML 頻率 - 最大:2.5GHz 電源電壓:2.375 V ~ 2.625 V 工作溫度:-40°C ~ 85°C 安裝類(lèi)型:表面貼裝 封裝/外殼:16-VFQFN 裸露焊盤(pán)，16-MLF? 供應(yīng)商設(shè)備封裝:16-MLF?（3x3） 包裝:帶卷 (TR)
ADCLK905BCPZ-TR 制造商:Analog Devices 功能描述:1:1 ECL,,7 GBPPS CLOCK/DATA BUFFERS - Tape and Reel
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