參數(shù)資料
型號： AD9644BCPZRL7-80
廠商： Analog Devices Inc
文件頁數(shù)： 31/44頁
文件大?。?/td> 0K
描述： IC ADC 14BIT 80MSPS 3V 48LFCSP
標(biāo)準(zhǔn)包裝： 750
位數(shù)： 14
采樣率（每秒）： 80M
數(shù)據(jù)接口： 串行，SPI?
轉(zhuǎn)換器數(shù)目： 2
功率耗散（最大）： 460mW
電壓電源： 模擬和數(shù)字
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 48-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 48-LFCSP-VQ（7x7）
包裝： 帶卷 (TR)
輸入數(shù)目和類型： 2 個(gè)差分，雙極
Data Sheet
AD9644
Rev. C | Page 37 of 44
Addr
(Hex)
Register
Name
Bit 7
(MSB)
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
(LSB)
Default
Value
(Hex)
Default/
Comments
0x65
JESD204A
bank
identification
number (BID)
(local)
Open
JESD204A serial bank identification number (BID)
0x00
0x66
JESD204A
lane
identification
number (LID)
for Lane 0
(local)
Open
JESD204A serial lane identification (LID) number for Lane 0
0x00
0x67
JESD204A
lane
identification
number (LID)
for Lane 1
(local)
Open
JESD204A serial lane identification (LID) number for Lane 1
0x01
0x6E
JESD204A
scrambler
(SCR) and lane
(L)
configuration
register
Enable
serial
scrambler
mode
(SCR)
(local)
Open
Lane control
(global)
0 = one lane
per link (L = 1)
1 = two lanes
per link (L = 2)
0x80
0x6F
JESD204A
number of
octets per
frame (F)
(global)
JESD204A number of octets per frame (F)—these bits are calculated based on the equation: F = M × (2 ÷ L)
0x01
Read only
0x70
JESD204A
number of
frames per
multiframe (K)
(local)
Open
JESD204A number of frames per multiframe (K)
0x0F
0x71
JESD204A
number of
converters per
link (M)
(global)
Open
Number of
converters
per link (M)
0 = link
connected
to one ADC
(M = 1)
1 = link
connected
to two ADCs
(M = 2)
0x00
0x72
JESD 204A
ADC
resolution (N)
and control
bits per
sample (CS)
(local)
Number of control bits
per sample (CS)
00 = no control bits
(CS = 0)
01 = one control bit
(CS = 1)
10 = two control bits
(CS = 2)
11 = unused
Open
Converter resolution (N) (read only)
0x4D
0x73
JESD204A
total bits per
sample (N’)
(global)
Open
Total bits per sample (N’) (read only)
0x0F
Read only
0x74
JESD204A
samples per
converter (S)
frame cycle
(global)
Open
Samples per converter (S) frame cycle (read only)
Always 1 for the AD9644
0x00
Read only
0x75
JESD204A HD
and CF
configuration
(global)
Enable
high
density
format
(HD = 0,
read only)
Open
Number of control words per frame clock cycle per Link (CF) –
always 0 for the AD9644 (read only)
0x00
Read only
相關(guān)PDF資料
PDF描述
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參數(shù)描述
AD9644CCPZ-80 功能描述:IC ADC 14BIT 80MSPS 3V 48LFCSP RoHS:是 類別:集成電路 (IC) >> 數(shù)據(jù)采集 - 模數(shù)轉(zhuǎn)換器 系列:- 標(biāo)準(zhǔn)包裝:1 系列:- 位數(shù):14 采樣率（每秒）:83k 數(shù)據(jù)接口:串行，并聯(lián) 轉(zhuǎn)換器數(shù)目:1 功率耗散（最大）:95mW 電壓電源:雙 ± 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:28-DIP（0.600"，15.24mm） 供應(yīng)商設(shè)備封裝:28-PDIP 包裝:管件 輸入數(shù)目和類型:1 個(gè)單端，雙極
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