SCLK DON'T CARE SDIO Rev. B | Page 28 of 40 0 780 5- 0 16 A12 W0 W1 R/W A11 A10 A9 A8 A7 A6 A" />
參數(shù)資料
型號(hào)： AD9551BCPZ-REEL7
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 21/40頁(yè)
文件大?。?/td> 0K
描述： IC CLOCK GEN TRANSLATOR 40LFCSP
標(biāo)準(zhǔn)包裝： 1
類(lèi)型： 時(shí)鐘發(fā)生器
PLL： 是
輸入： 晶體
輸出： CMOS，LVDS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 2:2
差分 - 輸入:輸出： 是/是
頻率 - 最大： 900MHz
除法器/乘法器： 無(wú)/無(wú)
電源電壓： 3.3V
工作溫度： -40°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 40-VFQFN 裸露焊盤(pán)，CSP
供應(yīng)商設(shè)備封裝： 40-LFCSP-VQ（6x6）
包裝： 標(biāo)準(zhǔn)包裝
其它名稱： AD9551BCPZ-REEL7DKR
AD9551
CS
SCLK DON'T CARE
SDIO
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0
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5-
0
16
A12
W0
W1
R/W
A11 A10 A9 A8 A7 A6 A5 A4 A3 A2 A1 A0
D7 D6 D5 D4 D3 D2 D1 D0 D7 D6 D5 D4 D3 D2 D1 D0
DON'T CARE
16-BIT INSTRUCTION HEADER
REGISTER (N) DATA
REGISTER (N – 1) DATA
Figure 26. Serial Control Port Write—MSB First, 16-Bit Instruction, Two Bytes Data
0
780
5-
0
17
CS
SCLK
SDIO
REGISTER (N) DATA
16-BIT INSTRUCTION HEADER
REGISTER (N – 1) DATA
REGISTER (N – 2) DATA
REGISTER (N – 3) DATA
A12
W0
W1
R/W
A11 A10 A9 A8 A7 A6 A5 A4 A3 A2 A1 A0
DON'T CARE
D7 D6 D5 D4 D3 D2 D1 D0 D7 D6 D5 D4 D3 D2 D1 D0 D7 D6 D5 D4 D3 D2 D1 D0 D7 D6 D5 D4 D3 D2 D1 D0
Figure 27. Serial Control Port Read—MSB First, 16-Bit Instruction, Four Bytes Data
07
80
5-
0
18
tS
DON'T CARE
W1
W0
A12
A11
A10
A9A8A7A6A5
D4D3
D2D1D0
DON'T CARE
R/W
tDS
tDH
tHIGH
tLOW
tH
tCLK
CS
SCLK
SDIO
Figure 28. Serial Control Port Write—MSB First, 16-Bit Instruction, Timing Measurements
07
805
-01
DATA BIT N – 1
DATA BIT N
SDIO
9
CS
SCLK
tDV
Figure 29. Timing Diagram for Serial Control Port Register Read
CS
SCLK DON'T CARE
DON'T CARE
SDIO
DON'T CARE
A0
0
780
5-
0
20
16-BIT INSTRUCTION HEADER
REGISTER (N) DATA
REGISTER (N + 1) DATA
A1 A2 A3 A4 A5 A6 A7 A8 A9 A10 A11 A12
D1
D0
R/W
W1
W0
D2 D3 D4
D5 D6 D7 D0 D1 D2 D3 D4 D5 D6 D7
Figure 30. Serial Control Port Write—LSB First, 16-Bit Instruction, Two Bytes Data
tS
07
80
5-
0
21
SCLK
SDIO
tHIGH
tLOW
tCLK
tDS
tDH
tH
BIT N
BIT N + 1
CS
Figure 31. Serial Control Port Timing—Write
相關(guān)PDF資料
PDF描述
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