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參數(shù)資料
| 型號(hào)： | AD9547BCPZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 104/104頁 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GEN/SYNCHRONIZR 64LFCSP |
| 產(chǎn)品變化通告： | AD9547 Mask Change 20/Oct/2010 |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 類型： | 時(shí)鐘/頻率發(fā)生器，同步器 |
| PLL： | 是 |
| 主要目的： | 以太網(wǎng)，SONET/SDH，Stratum |
| 輸入： | CMOS，LVDS，LVPECL |
| 輸出： | CMOS，LVDS，LVPECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:2 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 750kHz |
| 電源電壓： | 1.71 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 64-VFQFN 裸露焊盤，CSP |
| 供應(yīng)商設(shè)備封裝： | 64-LFCSP-VQ（9x9） |
| 包裝： | 托盤 |
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Data Sheet
AD9547
Rev. E | Page 99 of 104
Table 158. EEPROM Storage Sequencefor Operational Control Settings
Address
Bit
Bit Name
Description
0x0E2F
[7:0]
Operational controls
The default value of this register is 0x10, which the controller interprets as a data
instruction. Its decimal value is 16, this tells the controller to transfer 17 bytes of data
(16 + 1) beginning at the address specifiedby the next two bytes. The controller stores
0x10 in the EEPROM and increments the EEPROM address pointer.
0x0E30
[7:0]
Operational controls
The default value of these two registers is 0x0A00. Note that Register 0x0E30 andRegister
0x0E31 are the most significant and least significant bytes of the target address,
respectively. Because the previous register contains a data instruction, these two
registers define a starting address (in this case, 0x0A00). The controller stores 0x0A00 in
the EEPROM and increments the EEPROM pointer by 2. It then transfers 17 bytes from
the register map (beginning at Address 0x0A00) to the EEPROM and incrementsthe
EEPROM address pointerby 18 (17data bytesandone checksumbyte). The 17 bytes
transferred correspond to the operational controls parameters inthe register map.
0x0E31
[7:0]
0x0E32
[7:0]
I/O update
The default value of this register is 0x80, which the controller interprets as an I/O
update instruction. The controller stores 0x80 in the EEPROM and increments the
EEPROM address pointer.
Table 159. EEPROM Storage Sequencefor End of Data
Address
Bits
Bit Name
Description
0x0E33
[7:0]
End of data
The default value of this register is 0xFF, which the controller interprets as an end
instruction. The controller stores this instruction in the EEPROM, resets the EEPROM
address pointer, and enters an idle state.
0x0E34 to
0x0E3F
Continuation of user
scratch pad area
This area is unused in the default configuration and is available for additional EEPROM
storage sequence commands. Note that the EEPROM storage sequence should always
end with either an end of data or pause command.
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PDF描述 |
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