參數(shù)資料
型號(hào)： AD9520-0/PCBZ
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 13/80頁(yè)
文件大小： 0K
描述： BOARD EVAL AD9520-0
設(shè)計(jì)資源： Synchronizing Multiple AD9910 1 GSPS Direct Digital Synthesizers (CN0121)
Phase Coherent FSK Modulator (CN0186)
AD9520 Eval Brd Schematic
AD9520 BOM
標(biāo)準(zhǔn)包裝： 1
主要目的： 計(jì)時(shí)，時(shí)鐘發(fā)生器
已用 IC / 零件： AD9520-0
已供物品： 板
AD9520-0
Data Sheet
Rev. A | Page 20 of 80
Pin No.
Input/
Output
Pin Type
Mnemonic
Description
47
O
LVPECL or
CMOS
OUT3 (OUT3B)
Clock Output. This pin can be configured as one side of a differential LVPECL output
or as a single-ended CMOS output.
48
O
LVPECL or
CMOS
OUT3 (OUT3A)
Clock Output. This pin can be configured as one side of a differential LVPECL output
or as a single-ended CMOS output.
50
O
LVPECL or
CMOS
OUT2 (OUT2B)
Clock Output. This pin can be configured as one side of a differential LVPECL output
or as a single-ended CMOS output.
51
O
LVPECL or
CMOS
OUT2 (OUT2A)
Clock Output. This pin can be configured as one side of a differential LVPECL output
or as a single-ended CMOS output.
52
O
LVPECL or
CMOS
OUT1 (OUT1B)
Clock Output. This pin can be configured as one side of a differential LVPECL output
or as a single-ended CMOS output.
53
O
LVPECL or
CMOS
OUT1 (OUT1A)
Clock Output. This pin can be configured as one side of a differential LVPECL output
or as a single-ended CMOS output.
55
O
LVPECL or
CMOS
OUT0 (OUT0B)
Clock Output. This pin can be configured as one side of a differential LVPECL output
or as a single-ended CMOS output.
56
O
LVPECL or
CMOS
OUT0 (OUT0A)
Clock Output. This pin can be configured as one side of a differential LVPECL output
or as a single-ended CMOS output.
58
O
Current set
resistor
RSET
Clock Distribution Current Set Resistor. Connect a 4.12 k resistor from this pin to GND.
62
O
Current set
resistor
CPRSET
Charge Pump Current Set Resistor. Connect a 5.1 k resistor from this pin to GND.
This resistor can be omitted if the PLL is not used.
63
I
Reference
input
REFIN (REF2)
Along with REFIN, this is the differential input for the PLL reference.
Alternatively, this pin is a single-ended input for REF2.
64
I
Reference
input
REFIN (REF1)
Along with REFIN, this is the differential input for the PLL reference.
Alternatively, this pin is a single-ended input for REF1.
EPAD
GND
The exposed die pad must be connected to GND.
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PDF描述
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參數(shù)描述
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AD9520-1/PCBZ 功能描述:BOARD EVAL FOR AD9520-1 RoHS:是 類(lèi)別:編程器，開(kāi)發(fā)系統(tǒng) >> 評(píng)估演示板和套件 系列:- 標(biāo)準(zhǔn)包裝:1 系列:PSoC® 主要目的:電源管理，熱管理 嵌入式:- 已用 IC / 零件:- 主要屬性:- 次要屬性:- 已供物品:板，CD，電源
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AD9520-2 制造商:AD 制造商全稱:Analog Devices 功能描述:12 LVPECL/24 CMOS Output Clock Generator with Integrated 2.2 GHz VCO
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