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參數資料
| 型號： | AD1836ACSZ |
| 廠商： | Analog Devices Inc |
| 文件頁數： | 11/24頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CODEC 4ADC/6DAC 24 BIT 52MQFP |
| 標準包裝： | 1 |
| 類型： | 通用 |
| 數據接口： | 串行 |
| 分辨率（位）： | 24 b |
| ADC / DAC 數量： | 4 / 6 |
| 三角積分調變： | 是 |
| S/N 比，標準 ADC / DAC (db)： | 105 / 108 |
| 動態(tài)范圍，標準 ADC / DAC (db)： | 105 / 108 |
| 電壓 - 電源，模擬： | 4.75 V ~ 5.25 V |
| 電壓 - 電源，數字： | 4.75 V ~ 5.25 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 52-QFP |
| 供應商設備封裝： | 52-MQFP（10x10） |
| 包裝： | 托盤 |
| 配用： | AD1836AZ-DBRD-ND - BOARD EVAL FOR AD1836A |
Data Sheet
AD1836A
Rev. A | Page 19 of 24
SPI CONTROL REGISTERS
Note that all control registers default to zero at power-up.
Table 12. Serial SPI Word Format
Register Address
Read/Write
Reserved
Data Field
15:12
11
10
9:0
4 Bits
1 = Read
0 = Write
0
10 Bits
Table 13. Register Addresses and Functions
Register Address
RD/WR
Reserved
Function
Bit 15
Bit 14
Bit 13
Bit 12
Bit 11
Bit 10
Bits 9:0
0
DAC Control 1
0
1
0
DAC Control 2
0
1
0
DAC1L Volume
0
1
0
DAC1R Volume
0
1
0
DAC2L Volume
0
1
0
1
0
DAC2R Volume
0
1
0
DAC3L Volume
0
1
0
DAC3R Volume
1
0
ADC1L—Peak Level (Read-Only)
1
0
1
0
ADC1R—Peak Level (Read-Only)
1
0
1
0
ADC2L—Peak Level (Read-Only)
1
0
1
0
ADC2R—Peak Level (Read-Only)
1
0
ADC Control 1
1
0
1
0
ADC Control 2
1
0
ADC Control 3
1
0
Reserved
Table 14. DAC Control Register 1
Packed Mode: Eight channels are “packed” in DSDATA1 serial input. Packed Mode 128: Refer to Figure 7. Packed Mode 256: Refer to Figure 8.
Address
RD/WR
Reserved
Function
De-emphasis
Serial Mode
Data-Word
Width
Power-Down
Interpolator
Mode
Reserved
15, 14, 13, 12
11
10
9, 8
7, 6, 5
4, 3
2
1
0
0000
0
00 = None
01 = 44.1 kHz
10 = 32.0 kHz
11 = 48.0 kHz
000 = I2S
001 = RJ
010 = DSP
011 = LJ
100 = Packed Mode 256
101 = Packed Mode 128
110 = Reserved
111 = Reserved
00 = 24 Bits
01 = 20 Bits
10 = 16 Bits
11 = Reserved
0 = Normal
1 = PWRDWN
0 = 8× (48 kHz)
1 = 4× (96 kHz)
0
相關PDF資料 |
PDF描述 |
|---|---|
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參數描述 |
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