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參數(shù)資料
| 型號(hào)： | 935267395557 |
| 廠(chǎng)商： | NXP SEMICONDUCTORS |
| 元件分類(lèi)： | 顏色信號(hào)轉(zhuǎn)換 |
| 英文描述： | COLOR SIGNAL DECODER, PBGA156 |
| 封裝： | 15 X 15 MM, 1.15 MM HEIGHT, PLASTIC, MS-034, SOT-472-1, BGA-156 |
| 文件頁(yè)數(shù)： | 154/178頁(yè) |
| 文件大?。?/td> | 988K |
| 代理商： | 935267395557 |
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2004 Jul 22
77
Philips Semiconductors
Product specication
Multistandard video decoder with adaptive
comb lter and component video input
SAA7118
9.7
Host port for 16-bit extension of video data I/O (H port)
The H port pins HPD can be used for extension of the data I/O paths to 16-bit.
The I port has functional priority. If I8_16[93H[6]] is set to logic 1 the output drivers of the H port are enabled depending
on the I port enable control. For I8_16 = 0, the HPD output is disabled.
Table 34 Signals dedicated to the host port
Note
1. Pin numbers for QFP160 in parenthesis.
SYMBOL
I/O
DESCRIPTION
BIT
HPD7 to HPD0
G13, F14, F13, E14, E12,
E13, E11 and D14 (103,
105, 107 and 109 to 113)
I/O
16-bit extension for digital I/O
(chrominance component)
IPE[1:0] 87H[1:0], ITRI[8FH[6]]
and I8_16[93H[6]]
9.8
Basic input and output timing diagrams I port
and X port
9.8.1
I PORT OUTPUT TIMING
The following diagrams illustrate the output timing via the
I port. IGPH and IGPV are logic 1 active gate signals.
If reference pulses are programmed, these pulses are
generated on the rising edge of the logic 1 active gates.
Valid data is accompanied by the output data qualifier on
pin IDQ. In addition invalid cycles are marked with output
code 00H.
The IDQ output pin may be defined to be a gated clock
output signal (ICLK AND internal IDQ).
9.8.2
X PORT INPUT TIMING
At the X port the input timing requirements are the same as
those for the I port output. But different to those below:
It is not necessary to mark invalid cycles with a 00H
code
No constraints on the input qualifier (can be a random
pattern)
XCLK may be a gated clock (XCLK AND external XDQ).
for an uninterrupted output stream (no handshake with the
external hardware).
Fig.38 Output timing I port for serial 8-bit data at start of a line (ICODE = 1).
IPD[7:0]
IGPH
IDQ
ICLK
00
FF
00
SAV
00
CB
Y
CR
Y00
CB
Y
CR
Y00
MHB550
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 935268832557 | COLOR SIGNAL DECODER, PQFP160 |
| 935273916518 | COLOR SIGNAL DECODER, PBGA156 |
| 935273916557 | COLOR SIGNAL DECODER, PBGA156 |
| 935268460118 | 1-CHANNEL, SGL POLE SGL THROW SWITCH, PDSO5 |
| 935268459115 | 1-CHANNEL, SGL POLE SGL THROW SWITCH, PDSO5 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 935268081112 | 制造商:NXP Semiconductors 功能描述:SUB ONLY IC |
| 935268721125 | 制造商:NXP Semiconductors 功能描述:Buffer/Line Driver 1-CH Non-Inverting 3-ST CMOS 5-Pin TSSOP T/R |
| 935269304128 | 制造商:ST-Ericsson 功能描述:IC AUDIO CODEC W/TCH SCRN 48LQFP |
| 935269544557 | 制造商:NXP Semiconductors 功能描述:SUB ONLY TDA9587-2US1-V1.3 |
| 935269987557 | 制造商:NXP Semiconductors 功能描述:SUB ONLY TDA9587-1US1-V1.8 SUBBED TO 935269987557 |
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