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Intel
82801BA ICH2 Datasheet
9-39
LPC Interface Bridge Registers (D31:F0)
9.4.10
ELCR1—Master Controller Edge/Level Triggered Register
Offset Address:
Default Value:
4D0h
00h
Attribute:
Size:
R/W
8 bits
In edge mode, (bit[x] = 0), the interrupt is recognized by a low to high transition. In level mode
(bit[x] = 1), the interrupt is recognized by a high level. The cascade channel, IRQ2, the heart beat
timer (IRQ0), and the keyboard controller (IRQ1), cannot be put into level mode.
Bit
Description
7
IRQ7 ECL
—R/W.
0 = Edge.
1 = Level.
6
IRQ6 ECL
—R/W.
0 = Edge.
1 = Level.
5
IRQ5 ECL
—R/W.
0 = Edge.
1 = Level.
4
IRQ4 ECL
—R/W.
0 = Edge.
1 = Level.
3
IRQ3 ECL
—R/W.
0 = Edge.
1 = Level.
2:0
Reserved. Must be 0.
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PDF描述 |
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| 82801DB | Intel 82801DB I/O Controller Hub 4 (ICH4) |
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| 82803AAMRH-R | Controller Miscellaneous - Datasheet Reference |
| 82804AA | Interface IC |
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參數(shù)描述 |
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