參數(shù)資料
型號: 7540
英文描述: 250MA CMOS LDO, ISUPPLY 1UA & 2% VOUT ACCURACY, -40C to +125C, 3-SOT-89, T/R
中文描述: 7540群用戶手冊數(shù)據(jù)4267K/MAY.28.03
文件頁數(shù): 182/365頁
文件大?。?/td> 4267K
代理商: 7540
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁當(dāng)前第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁第266頁第267頁第268頁第269頁第270頁第271頁第272頁第273頁第274頁第275頁第276頁第277頁第278頁第279頁第280頁第281頁第282頁第283頁第284頁第285頁第286頁第287頁第288頁第289頁第290頁第291頁第292頁第293頁第294頁第295頁第296頁第297頁第298頁第299頁第300頁第301頁第302頁第303頁第304頁第305頁第306頁第307頁第308頁第309頁第310頁第311頁第312頁第313頁第314頁第315頁第316頁第317頁第318頁第319頁第320頁第321頁第322頁第323頁第324頁第325頁第326頁第327頁第328頁第329頁第330頁第331頁第332頁第333頁第334頁第335頁第336頁第337頁第338頁第339頁第340頁第341頁第342頁第343頁第344頁第345頁第346頁第347頁第348頁第349頁第350頁第351頁第352頁第353頁第354頁第355頁第356頁第357頁第358頁第359頁第360頁第361頁第362頁第363頁第364頁第365頁
7540 Group User
s Manual
APPLICATION
2-107
2.6 Serial I/O1
Fig. 2.6.10 Setting method for clock synchronous serial I/O1 (1)
In
t
e
r
r
u
p
t
c
o
n
t
r
o
l
r
e
g
i
s
t
e
r
1
(
I
C
O
N
1
)
[
A
d
d
r
e
s
s
3
E
1
6
]
b
7
b
0
S
S
e
r
r
i
i
a
a
l
l
I
I
/
/
O
O
1
1
r
t
e
r
c
e
n
i
v
m
e
t
i
n
i
t
e
t
r
r
r
u
r
p
u
t
t
d
i
s
i
a
s
b
a
l
e
l
d
e
e
a
s
i
n
e
p
d
b
d
0
B
a
u
d
r
a
t
e
g
e
n
e
r
a
t
o
r
(
B
R
G
)
[
A
d
d
r
e
s
s
1
C
1
6
]
Set baud rate value
b
7
b
0
0 0
P
r
o
c
e
s
s
1
:
S
t
o
p
a
n
d
i
n
i
t
i
a
l
i
z
e
s
e
r
i
a
l
I
/
O
.
S
e
r
i
a
l
I
/
O
1
c
o
n
t
r
o
l
r
e
g
i
s
t
e
r
(
S
I
O
1
C
O
N
)
[
A
d
d
r
e
s
s
1
A
1
6
]
T
R
r
a
e
n
c
s
m
v
i
t
o
o
p
p
e
r
a
a
t
i
i
o
o
n
s
s
t
t
o
o
p
a
a
n
n
d
i
i
n
n
i
i
t
t
i
i
a
a
l
i
i
z
z
e
e
d
e
i
e
e
r
t
n
p
d
l
d
0
BRG count source selected (set in internal clock selected)
0: f(X
IN
)
1: f(X
IN
)/4
Serial I/O1 synchronous clock selected
0: BRG output/4 (
Note 1
)
1: External clock input
S
RDY1
output enable selected
0: P1
3
pin operates as normal I/O pin
1: P1
3
pin operates as S
RDY1
output pin (
Note 2
)
Transmit interrupt source selected
0: When transmit buffer has emptied
1: When transmit shift operation is completed
Transmit enable selected
0: Transmit disabled (at half-duplex communication receive)
1: Transmit enabled (at full-duplex communication) (
Note 3
)
Receive enable selected
0: Receive disabled (at half-duplex communication transmit)
1: Receive enabled (at full-duplex communication) (
Note 3
)
Clock synchronous serial I/O
Serial I/O1 enabled
(P1
0
P1
3
pins operate as serial I/O1 pins)
S
e
r
i
a
l
I
/
O
1
c
o
n
t
r
o
l
r
e
g
i
s
t
e
r
(
S
I
O
1
C
O
N
)
[
A
d
d
r
e
s
s
1
A
1
6
]
P
r
o
c
e
s
s
3
:
S
e
t
s
e
r
i
a
l
I
/
O
1
c
o
n
t
r
o
l
r
e
g
i
s
t
e
r
.
b
1 1
7
b
0
Notes 1:
Setting of serial I/O1 synchronous selection bit is as follows:
0
: P1
2
pin is set to be an output pin of the synchronous clock.
1
: P1
2
pin is set to be an input pin of the synchronous clock.
2:
When an external clock input is selected as the synchronous clock, and the receiver
performs the S
RDY1
output, set
1
to the transmit enable bit in addition to the receive
enable bit and S
RDY1
output enable bit.
3:
When data transmission is executed at the state that an external clock input is
selected as the synchronous clock, set
1
to the transmit enable bit while the S
CLK1
is
H
state.
P
r
o
c
e
s
s
2
:
D
i
s
a
b
l
e
s
e
r
i
a
l
I
/
O
1
t
r
a
n
s
m
i
t
/
r
e
c
e
i
v
e
i
n
t
e
r
r
u
p
t
.
Process 4: When BRG output/4 is selected as synchronous clock, set value to baud rate generator.
(2) Clock synchronous serial I/O setting method
Figure 2.6.10 and Figure 2.6.11 show the setting method for the clock synchronous serial I/O1.
相關(guān)PDF資料
PDF描述
7542 250mA CMOS LDO, lsupply 1uA and 2% Vout Accuracy, -40C to +125C, 3-SOT-23, T/R
7544 3.3V LDO POSITVE VOLTAGE REGULATOR 2% TOL.
75450PC Peripheral IC
D122D Converter IC
D347D Logic IC
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
7540_M 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:8-BIT CISC SINGLE-CHIP MICROCOMPUTER 740 FAMILY / 740 SERIES
75400 制造商:Honeywell Sensing and Control 功能描述:
7-5-4004 功能描述:3M 4004 DOUBLE COATED URETHANE F 制造商:3m (tc) 系列:4004 零件狀態(tài):在售 標(biāo)準(zhǔn)包裝:1
7-5-4008 功能描述:3M 4008 DOUBLE COATED URETHANE F 制造商:3m (tc) 系列:4008 零件狀態(tài):在售 標(biāo)準(zhǔn)包裝:1
754010 制造商: 功能描述: 制造商:undefined 功能描述: