參數(shù)資料
型號： 74HC7046A
廠商： NXP Semiconductors N.V.
英文描述： Phase-locked-loop with lock detector
中文描述： 鎖相回路鎖定探測器
文件頁數(shù)： 29/38頁
文件大?。?/td> 490K
代理商： 74HC7046A
December 1990
29
Philips Semiconductors
Product specification
Phase-locked-loop with lock detector
74HC/HCT7046A
PLL conditions
with no signal at
the SIG
IN
input
PLL frequency
capture range
PC1
VCO adjusts to f
o
with
φ
DEMOUT
= 90
°
and V
VCOIN
= 1/2 V
CC
(see Fig.6).
PC2
VCO adjusts to f
o
with
φ
DEMOUT
=
360
°
and V
VCOIN
= min. (see Fig.8).
PC1, PC2
Loop filter component selection
(a)
τ
= R3 x C2
(b) amplitude characteristic
Fig. 25 Simple loop filter for PLL
without
offset; R3
≥
500
.
(c) pole-zero diagram
(a)
τ
1 = R3 x C2;
τ
2 = R4 x C2;
τ
3 = (R3 + R4) x C2
Fig. 26 Simple loop filter for PLL
with
offset; R3
+
R4
≥
500
.
yes
(b) amplitude characteristic
(c) pole-zero diagram
PLL locks on
harmonics at
centre frequency
noise rejection at
signal input
PC1
PC2
no
PC1
PC2
PC1
high
low
f
r
= 2f
i
, large ripple content at
φ
DEMOUT
= 90
°
AC ripple content
when PLL is
locked
PC2
f
r
= f
i
, small ripple content at
φ
DEMOUT
= 0
°
SUBJECT
PHASE
COMPARATOR
DESIGN CONSIDERATIONS
相關(guān)PDF資料
PDF描述
74HCT7046A Phase-locked-loop with lock detector(帶鎖檢測的鎖相環(huán))
74HC7080 16-bit even/odd parity generator/checker
74HCT7080 Dual 4-Input Positive-NAND Gates 14-PDIP -40 to 85
74HC7245 Octal bus Schmitt-trigger transceiver; 3-state
74HCT7245 Dual 4-Input Positive-NAND Gates 14-SO -40 to 85
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
74HC7046AD 功能描述:鎖相環(huán) - PLL PHASE LOCKED LOOP W/DETECTOR RoHS:否 制造商:Silicon Labs 類型:PLL Clock Multiplier 電路數(shù)量:1 最大輸入頻率:710 MHz 最小輸入頻率:0.002 MHz 輸出頻率范圍:0.002 MHz to 808 MHz 電源電壓-最大:3.63 V 電源電壓-最小:1.71 V 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:QFN-36 封裝:Tray
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