參數(shù)資料
型號： 74F125
廠商： Fairchild Semiconductor Corporation
英文描述： Quad Buffer (3-STATE)
中文描述： 四緩沖器（三態(tài)）
文件頁數(shù)： 2/10頁
文件大?。?/td> 77K
代理商： 74F125
Philips Semiconductors
Product specification
74F125, 74F126
Quad buffers (3-State)
2
March 28, 1989
853–0341 96146
FEATURE
High impedance NPN base inputs for reduced loading
(20
μ
A in High and Low states)
TYPE
TYPICAL
PROPAGATION
DELAY
TYPICAL
SUPPLY CURRENT
(TOTAL)
74F125
5.0ns
23mA
74F126
5.0ns
26mA
ORDERING INFORMATION
DESCRIPTION
COMMERCIAL RANGE
V
CC
= 5V
±
10%,
T
amb
= 0
°
C to +70
°
C
PKG DWG #
14-pin plastic DIP
N74F125N, N74F126N
SOT27-1
14-pin plastic SO
N74F125D, N74F126D
SOT108-1
INPUT AND OUTPUT LOADING AND FAN OUT TABLE
PINS
DESCRIPTION
74F (U.L.) HIGH/LOW
LOAD VALUE HIGH/LOW
D0–D3
Data inputs
1.0/0.033
20
μ
A/20
μ
A
OE0–OE3
Output Enable inputs (active Low), 74F125
1.0/0.033
20
μ
A/20
μ
A
OE0–OE3
Output Enable inputs (active High), 74F126
1.0/0.033
20
μ
A/20
μ
A
Q0–Q3
Data outputs
750/106.7
15mA/64mA
NOTE:
One (1.0) FAST unit load is defined as: 20
μ
A in the High state and 0.6mA in the Low state.
PIN CONFIGURATIONS
14
13
12
11
10
9
8
7
6
5
4
3
2
1
GND
V
CC
OE2
D2
Q2
Q3
OE3
D3
OE0
D0
Q1
Q0
OE1
D1
SF00117
74F125
14
13
12
11
10
9
8
7
6
5
4
3
2
1
GND
V
CC
OE2
D2
Q2
Q3
OE3
D3
OE0
D0
Q1
Q0
OE1
D1
SF00118
74F126
LOGIC SYMBOLS
Q0
Q0
Q1
Q1
3
6
8
11
V
= Pin 14
GND = Pin 7
1
4
10
13
OE0
OE1
OE2
OE3
D1
D2
9
12
SF00119
D3
D0
2
5
74F125
Q0
Q0
Q1
Q1
3
6
8
11
V
= Pin 14
GND = Pin 7
1
4
10
13
OE0
OE1
OE2
OE3
D1
D2
9
12
SF00120
D3
D0
2
5
74F126
相關PDF資料
PDF描述
74F125PC Quad Buffer (3-STATE)
74F125SC Quad Buffer (3-STATE)
74F125SJ Quad Buffer (3-STATE)
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74F132SJX Quad 2-input NAND Gate
相關代理商/技術參數(shù)
參數(shù)描述
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74F125D SIG9241 制造商:SIG 功能描述:74F125D S1I2C
74F125DSIG9241 制造商:SIG 功能描述:74F125D S1I2C
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